參數(shù)資料
型號(hào)： EP2S30F484C4N
廠商： Altera
文件頁(yè)數(shù)： 593/768頁(yè)
文件大小： 0K
描述： IC STRATIX II FPGA 30K 484-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 20
系列： Stratix® II
LAB/CLB數(shù)： 1694
邏輯元件/單元數(shù)： 33880
RAM 位總計(jì)： 1369728
輸入/輸出數(shù)： 342
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA（23x23）
其它名稱： 544-1891
EP2S30F484C4N-ND
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7–80
Altera Corporation
Stratix II Device Handbook, Volume 2
January 2008
Passive Parallel Asynchronous Configuration
All devices start and complete configuration at the same time.
Figure 7–32 shows multi-device PPA configuration when both devices are
receiving the same configuration data.
Figure 7–32. Multiple-Device PPA Configuration Using a Microprocessor When Both devices Receive the
Same Data
(1)
If not used, the CS pin can be connected to VCC directly. If not used, the nCS pin can be connected to GND directly.
(2)
The pull-up resistor should be connected to a supply that provides an acceptable input signal for all devices in the
chain. VCC should be high enough to meet the VIH specification of the I/O on the device and the external host.
(3)
The nCEO pins of both devices are left unconnected when configuring the same configuration data into multiple
devices.
You can use a single configuration chain to configure Stratix II or
Stratix II GX devices with other Altera devices that support PPA
configuration, such as Stratix, Mercury, APEX 20K, ACEX 1K, and
FLEX 10KE devices. To ensure that all devices in the chain complete
configuration at the same time or that an error flagged by one device
initiates reconfiguration in all devices, all of the device CONF_DONE and
nSTATUS
pins must be tied together.
f
For more information on configuring multiple Altera devices in the same
configuration chain, refer to the Configuring Mixed Altera FPGA Chains
chapter in volume 2 of the Configuration Handbook.
GND
VCC
Address Decoder
ADDR
Memory
DATA[7..0]
nCS (1)
CS (1)
CONF_DONE
nSTATUS
nCE
nWS
nRS
nCONFIG
RDYnBSY
nCS (1)
CS (1)
CONF_DONE
nSTATUS
nCE
nWS
nRS
nCONFIG
RDYnBSY
Microprocessor
DATA[7..0]
VCC
DATA[7..0]
nCEO
N.C. (3)
nCEO
(2)
DCLK
VCC (2)
DCLK
(2)
VCC
Stratix II Device
10 k
Ω
10 k
Ω
10 k
Ω
10 k
Ω
N.C. (3)
GND
MSEL3
MSEL2
MSEL1
MSEL0
VCC
GND
MSEL3
MSEL2
MSEL1
MSEL0
VCC
GND
相關(guān)PDF資料
PDF描述
AIML-0603-8R2K-T INDUCTOR MULTILAYER 8200NH 0603
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GEM25DRKN-S13 CONN EDGECARD 50POS .156 EXTEND
ESC65DRES-S93 CONN EDGECARD 130POS .100 EYELET
EP2S30F484C4 IC STRATIX II FPGA 30K 484-FBGA
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EP2S30F484C5 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S30F484C5N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S30F484I4 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 FPGA - Stratix II 1694 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S30F484I4AA 制造商:Altera Corporation 功能描述:FPGA Stratix 制造商:Altera Corporation 功能描述:FPGA Stratix? II Family 33880 Cells 711.24MHz 90nm Technology 1.2V 484-Pin FBGA
EP2S30F484I4AB 制造商:Altera Corporation 功能描述:FPGA Stratix
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