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參數(shù)資料
| 型號： | EP2S180F1020C4 |
| 廠商： | Altera |
| 文件頁數(shù)： | 163/768頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX II FPGA 180K 1020FBGA |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 6 |
| 系列： | Stratix® II |
| LAB/CLB數(shù)： | 8970 |
| 邏輯元件/單元數(shù)： | 179400 |
| RAM 位總計： | 9383040 |
| 輸入/輸出數(shù)： | 742 |
| 電源電壓： | 1.15 V ~ 1.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1020-BBGA |
| 供應商設備封裝： | 1020-FBGA（33x33） |
| 配用： | 544-1701-ND - DSP PRO KIT W/SII EP2S180N |
| 其它名稱： | 544-1415 |
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Altera Corporation
5–99
April 2011
Stratix II Device Handbook, Volume 1
DC & Switching Characteristics
January 2005,
v2.0
● Updated the “Power Consumption” section.
● Added the “High-Speed I/O Specifications” and
“On-Chip Termination Specifications” sections.
● Removed the ESD Protection Specifications
section.
● Updated Tables 5–3 through 5–13, 5–16 through
5–18, 5–21, 5–35, 5–39, and 5–40.
● Updated tables in “Timing Model” section.
● Added Tables 5–30 and 5–31.
—
October 2004,
v1.2
● Updated Table 5–3.
● Updated introduction text in the “PLL Timing
Specifications” section.
—
July 2004, v1.1
● Re-organized chapter.
● Added typical values and COUTF B to Table 5–32.
● Added undershoot specification to Note (4) for
Tables 5–1 through 5–9.
● Added Note (1) to Tables 5–5 and 5–6.
● Added VID and VICM to Table 5–10.
● Added “I/O Timing Measurement Methodology”
section.
● Added Table 5–72.
● Updated Tables 5–1 through 5–2 and Tables 5–24
through 5–29.
—
February 2004,
v1.0
Added document to the Stratix II Device Handbook.
—
Table 5–103. Document Revision History (Part 3 of 3)
Date and
Document
Version
Changes Made
Summary of Changes
相關PDF資料 |
PDF描述 |
|---|---|
| HSC49DRAN | CONN EDGECARD 98POS R/A .100 SLD |
| HSC49DRAH | CONN EDGECARD 98POS R/A .100 SLD |
| ESC35DTEF | CONN EDGECARD 70POS .100 EYELET |
| FMM25DSES-S243 | CONN EDGECARD 50POS .156 EYELET |
| HSM12DREF | CONN EDGECARD 24POS .156 EYELET |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EP2S180F1020C4N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S180F1020C5 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S180F1020C5N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S180F1020I4 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2S180F1020I4N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 8970 LABs 742 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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