參數(shù)資料
型號： EP2S15F484C3
廠商： Altera
文件頁數(shù)： 27/768頁
文件大?。?/td> 0K
描述： IC STRATIX II FPGA 15K 484-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標準包裝： 20
系列： Stratix® II
LAB/CLB數(shù)： 780
邏輯元件/單元數(shù)： 15600
RAM 位總計： 419328
輸入/輸出數(shù)： 342
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA（23x23）
其它名稱： 544-1873
EP2S15F484C3-ND
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2–104
Altera Corporation
Stratix II Device Handbook, Volume 1
May 2007
Document Revision History
Document
Revision History
Table 2–27 shows the revision history for this chapter.
Table 2–27. Document Revision History (Part 1 of 2)
Date and
Document
Version
Changes Made
Summary of Changes
May 2007, v4.3 Updated “Clock Control Block” section.
—
Updated note in the “Clock Control Block” section.
—
Deleted Tables 2-11 and 2-12.
—
Updated notes to:
—
Updated notes to Table 2–18.
—
Moved Document Revision History to end of the chapter.
—
August 2006,
v4.2
Updated Table 2–18 with note.
—
April 2006,
v4.1
● Updated Table 2–13.
● Removed Note 2 from Table 2–16.
● Updated “On-Chip Termination” section and Table 2–19 to
include parallel termination with calibration information.
● Added new “On-Chip Parallel Termination with Calibration”
section.
● Updated Figure 2–44.
● Added parallel on-
chip termination
description and
specification.
● Changed RCLK
names to match the
Quartus II software in
Table 2–13.
December
2005, v4.0
Updated “Clock Control Block” section.
—
July 2005, v3.1 ● Updated HyperTransport technology information in Table 2–18.
● Updated HyperTransport technology information in
Figure 2–57.
● Added information on the asynchronous clear signal.
—
May 2005, v3.0 ● Updated “Functional Description” section.
● Updated Table 2–3.
● Updated “Clock Control Block” section.
● Updated Tables 2–17 through 2–19.
● Updated Tables 2–20 through 2–22.
● Updated Figure 2–57.
—
March 2005,
2.1
● Updated “Functional Description” section.
● Updated Table 2–3.
—
相關(guān)PDF資料
PDF描述
EP2S15F484I4 IC STRATIX II FPGA 15K 484-FBGA
RMM06DRUI CONN EDGECARD 12POS DIP .156 SLD
EP1S20F672C7N IC STRATIX FPGA 20K LE 672-FBGA
VE-B64-CX CONVERTER MOD DC/DC 48V 75W
RSO-4809D CONV DC/DC 1W 36-72VIN +/-09VOUT
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EP2S15F484C3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S15F484C4 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S15F484C4N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S15F484C5 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
EP2S15F484C5N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix II 780 LABs 342 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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