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參數(shù)資料
| 型號： | EP2AGX125EF35I5 |
| 廠商： | Altera |
| 文件頁數(shù)： | 17/90頁 |
| 文件大小： | 0K |
| 描述： | IC ARRIA II GX 125K 1152FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 3 |
| 系列： | Arria II GX |
| LAB/CLB數(shù)： | 4964 |
| 邏輯元件/單元數(shù)： | 118143 |
| RAM 位總計： | 8315904 |
| 輸入/輸出數(shù)： | 452 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 1152-BBGA |
| 供應(yīng)商設(shè)備封裝： | 1152-FBGA（27x27） |
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1–16
Chapter 1: Device Datasheet for Arria II Devices
Electrical Characteristics
December 2013
Altera Corporation
Table 1–24 lists the single-ended SSTL and HSTL I/O reference voltage specifications
for Arria II GX devices.
Table 1–25 lists the single-ended SSTL and HSTL I/O reference voltage specifications
for Arria II GZ devices.
1.2 V
1.14
1.2
1.26
-0.3
0.35 ×
VCCIO
0.65 ×
VCCIO
VCCIO +
0.3
0.25 ×
VCCIO
0.75 ×
VCCIO
2-2
3.0-V PCI
2.85
3
3.15
—
0.3 ×
VCCIO
0.5 ×
VCCIO
3.6
0.1 ×
VCCIO
0.9 × VCCIO
1.5
-0.5
3.0-V PCI-X
2.85
3
3.15
—
0.35 ×
VCCIO
0.5 ×
VCCIO
—
0.1 ×
VCCIO
0.9 × VCCIO
1.5
-0.5
Table 1–23. Single-Ended I/O Standards for Arria II GZ Devices (Part 2 of 2)
I/O Standard
VCCIO (V)
VIL (V)
VIH (V)
VOL (V)
VOH (V)
IOL
(mA)
IOH
(mA)
Min
Typ
Max
Min
Max
Min
Max
Min
Table 1–24. Single-Ended SSTL and HSTL I/O Reference Voltage Specifications for Arria II GX Devices
I/O Standard
VCCIO (V)
VREF (V)
VTT (V)
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SSTL-2 Class I, II
2.375
2.5
2.625
0.49 ×
VCCIO
0.5 × VCCIO
0.51 ×
VCCIO
VREF -
0.04
VREF
VREF +
0.04
SSTL-18 Class I, II
1.71
1.8
1.89
0.833
0.9
0.969
VREF -
0.04
VREF
VREF +
0.04
SSTL-15 Class I, II
1.425
1.5
1.575
0.47 ×
VCCIO
0.5 × VCCIO
0.53 ×
VCCIO
0.47 ×
VCCIO
0.5 ×
VCCIO
0.53 ×
VCCIO
HSTL-18 Class I, II
1.71
1.8
1.89
0.85
0.9
0.95
0.85
0.9
0.95
HSTL-15 Class I, II
1.425
1.5
1.575
0.71
0.75
0.79
0.71
0.75
0.79
HSTL-12 Class I, II
1.14
1.2
1.26
0.48 ×
VCCIO
0.5 × VCCIO
0.52 ×
VCCIO
—VCCIO/2
—
Table 1–25. Single-Ended SSTL and HSTL I/O Reference Voltage Specifications for Arria II GZ Devices
I/O Standard
VCCIO (V)
VREF (V)
VTT (V)
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
SSTL-2 Class I, II
2.375
2.5
2.625
0.49 ×
VCCIO
0.5 × VCCIO
0.51 ×
VCCIO
VREF -
0.04
VREF
VREF +
0.04
SSTL-18 Class I, II
1.71
1.8
1.89
0.833
0.9
0.969
VREF -
0.04
VREF
VREF +
0.04
SSTL-15 Class I, II
1.425
1.5
1.575
0.47 ×
VCCIO
0.5 × VCCIO
0.53 ×
VCCIO
0.47 ×
VCCIO
VREF
0.53 ×
VCCIO
HSTL-18 Class I, II
1.71
1.8
1.89
0.85
0.9
0.95
—
VCCIO/2
—
HSTL-15 Class I, II
1.425
1.5
1.575
0.68
0.75
0.9
—
VCCIO/2
—
HSTL-12 Class I, II
1.14
1.2
1.26
0.47 ×
VCCIO
0.5 × VCCIO
0.53 ×
VCCIO
—VCCIO/2
—
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PDF描述 |
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參數(shù)描述 |
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| EP2AGX190EF29C4 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Arria II GX 7612 LABs 372 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX190EF29C4N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Arria II GX 7612 LABs 372 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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