參數(shù)資料
型號(hào)： EP2AGX125DF25C5
廠商： Altera
文件頁(yè)數(shù)： 39/90頁(yè)
文件大?。?/td> 0K
描述： IC ARRIA II GX FPGA 125K 572FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 5
系列： Arria II GX
LAB/CLB數(shù)： 4964
邏輯元件/單元數(shù)： 118143
RAM 位總計(jì)： 8315904
輸入/輸出數(shù)： 260
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 572-FBGA
供應(yīng)商設(shè)備封裝： 572-FBGA
1–36
Chapter 1: Device Datasheet for Arria II Devices
Switching Characteristics
December 2013
Altera Corporation
Table 1–39 lists typical transmitter pre-emphasis levels for Arria II GZ devices (in dB)
for the first post tap under the following conditions (low-frequency data pattern [five
1s and five 0s] at 6.25 Gbps). The levels listed in Table 1–39 are a representation of
possible pre-emphasis levels under the specified conditions only and that the pre-
emphasis levels may change with data pattern and data rate.
f To predict the pre-emphasis level for your specific data rate and pattern, run
simulations using the Arria II HSSI HSPICE models.
Table 1–39. Transmitter Pre-Emphasis Levels for Arria II GZ Devices (Part 1 of 2)
Pre-
Emphasis
1st
Post-Tap
Setting
VOD Setting
012345
67
0
000000
00
1
N/A
0.7
0000
00
2
N/A
1
0.3
000
00
3
N/A
1.5
0.6
000
00
4
N/A
20.7
0.30
0
5
N/A
2.7
1.2
0.5
0.3
0
6
N/A
3.1
1.3
0.8
0.5
0.2
0
7
N/A
3.7
1.8
1.1
0.7
0.4
0.2
0
8
N/A
4.2
2.1
1.3
0.9
0.6
0.3
0
9
N/A
4.9
2.4
1.6
1.2
0.8
0.5
0.2
10
N/A
5.4
2.8
1.9
1.4
1
0.7
0.3
11
N/A
6
3.2
2.2
1.7
1.2
0.9
0.4
12
N/A
6.8
3.5
2.6
1.9
1.4
1.1
0.6
13
N/A
7.5
3.8
2.8
2.1
1.6
1.2
0.6
14
N/A
8.1
4.2
3.1
2.3
1.7
1.3
0.7
15
N/A
8.8
4.5
3.4
2.6
1.9
1.5
0.8
16
N/A
4.9
3.7
2.9
2.2
1.7
0.9
17
N/A
5.3
4
3.1
2.4
1.8
1.1
18
N/A
5.7
4.4
3.4
2.6
2
1.2
19
N/A
6.1
4.7
3.6
2.8
2.2
1.4
20
N/A
6.6
5.1
4
3.1
2.4
1.5
21
N/A
7
5.4
4.3
3.3
2.7
1.7
22
N/A
8
6.1
4.8
3.8
3
2
23
N/A
9
6.8
5.4
4.3
3.4
2.3
24
N/A
10
7.6
6
4.8
3.9
2.6
25
N/A
11.4
8.4
6.8
5.4
4.4
3
26
N/A
12.6
9.4
7.4
5.9
4.9
3.3
27
N/A
10.3
8.1
6.4
5.3
3.6
28
N/A
11.3
8.8
7.1
5.8
4
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