參數(shù)資料
型號： EP20K600CF672I9ES
元件分類： CPU監(jiān)測
英文描述： RTC Module With CPU Supervisor
中文描述： 時鐘模塊CPU監(jiān)控
文件頁數(shù)： 64/114頁
文件大?。?/td> 1623K
代理商： EP20K600CF672I9ES
Altera Corporation
53
APEX 20K Programmable Logic Device Family Data Sheet
Tables 17 and 18 summarize the ClockLock and ClockBoost parameters
for APEX 20KE devices.
Table 17. APEX 20KE ClockLock & ClockBoost Parameters
Symbol
Parameter
Condition
Min
Typ
Max
Unit
tR
Input rise time
5ns
tF
Input fall time
5ns
tINDUTY
Input duty cycle
40
60
%
tINJITTER
Input jitter peak-to-peak
2
% of input
period
peak-to-
peak
tOUTJITTER Jitter on ClockLock or ClockBoost-
generated clock
0.35
% of
output period
RMS
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
45
55
%
tLOCK (2),
Time required for ClockLock or
ClockBoost to acquire lock
40
s
相關(guān)PDF資料
PDF描述
EP20K600EBC652-1ES FPGA
EP20K600EBC652-2ES FPGA
EP20K600EBC652-3ES FPGA
EP20K600EBI652-1ES FPGA
EP20K1000CB652I7ES Single Volatile 32-tap Digitally Controlled Potentiometer (XDCP™); Temperature Range: -40°C to 85°C; Package: 6-SOT-23 T&R
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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EP20K600EBC652-1ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA
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