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參數(shù)資料
| 型號： | EP20K200FC484-2ES |
| 英文描述： | 64K, 8K x 8 Bit; 5 Volt, Byte Alterable EEPROM; Temperature Range: 0°C to 70°C |
| 中文描述： | FPGA的 |
| 文件頁數(shù)： | 37/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K200FC484-2ES |
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Altera Corporation
29
APEX 20K Programmable Logic Device Family Data Sheet
Figure 16. APEX 20K Parallel Expanders
Embedded
System Block
The ESB can implement various types of memory blocks, including
dual-port RAM, ROM, FIFO, and CAM blocks. The ESB includes input
and output registers; the input registers synchronize writes, and the
output registers can pipeline designs to improve system performance. The
ESB offers a dual-port mode, which supports simultaneous reads and
writes at two different clock frequencies. Figure 17 shows the ESB block
diagram.
Figure 17. ESB Block Diagram
32 Signals from
Local Interconnect
To Next
Macrocell
From
Previous
Macrocell
Product-
Term
Select
Matrix
Product-
Term
Select
Matrix
Macrocell
Product-
Term Logic
Macrocell
Product-
Term Logic
Parallel Expander
Switch
Parallel Expander
Switch
wraddress[]
data[]
wren
inclock
inclocken
inaclr
rdaddress[]
q[]
rden
outclock
outclocken
outaclr
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K200FC484-3 | Field Programmable Gate Array (FPGA) |
| EP20K200FC484-3ES | FPGA |
| EP20K200FI484-1 | Field Programmable Gate Array (FPGA) |
| EP20K200FI484-1ES | FPGA |
| EP20K200FI484-2 | Field Programmable Gate Array (FPGA) |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| EP20K200FC484-2XN | 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 832 Macro 382 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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| EP20K200FC484-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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