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參數(shù)資料
| 型號： | EP20K200FC484-2 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 6/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K200FC484-2 |
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Altera Corporation
103
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K600E APEX 20KE devices.
Table 94. EP20K400E External Bidirectional Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
2.93
3.23
3.44
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
5.25
2.00
5.79
2.00
6.32
ns
tXZBIDIR
5.95
6.77
7.12
ns
tZXBIDIR
5.95
6.77
7.12
ns
tINSUBIDIRPLL
4.31
4.76
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
2.25
0.50
2.45
-
ns
tXZBIDIRPLL
2.94
3.43
-
ns
tZXBIDIRPLL
2.94
3.43
-
ns
Table 95. EP20K600E fMAX LE Timing Microparameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tSU
0.16
0.17
ns
tH
0.29
0.33
0.37
ns
tCO
0.65
0.38
0.49
ns
tLUT
0.70
1.00
1.30
ns
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K200FC484-2ES | 64K, 8K x 8 Bit; 5 Volt, Byte Alterable EEPROM; Temperature Range: 0°C to 70°C |
| EP20K200FC484-3 | Field Programmable Gate Array (FPGA) |
| EP20K200FC484-3ES | FPGA |
| EP20K200FI484-1 | Field Programmable Gate Array (FPGA) |
| EP20K200FI484-1ES | FPGA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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| EP20K200FC484-3 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 832 Macro 382 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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