參數(shù)資料
型號： EP20K200CP240C9
英文描述： ASIC
中文描述： 專用集成電路
文件頁數(shù)： 64/114頁
文件大?。?/td> 1623K
代理商： EP20K200CP240C9
Altera Corporation
53
APEX 20K Programmable Logic Device Family Data Sheet
Tables 17 and 18 summarize the ClockLock and ClockBoost parameters
for APEX 20KE devices.
Table 17. APEX 20KE ClockLock & ClockBoost Parameters
Symbol
Parameter
Condition
Min
Typ
Max
Unit
tR
Input rise time
5ns
tF
Input fall time
5ns
tINDUTY
Input duty cycle
40
60
%
tINJITTER
Input jitter peak-to-peak
2
% of input
period
peak-to-
peak
tOUTJITTER Jitter on ClockLock or ClockBoost-
generated clock
0.35
% of
output period
RMS
tOUTDUTY
Duty cycle for ClockLock or
ClockBoost-generated clock
45
55
%
tLOCK (2),
Time required for ClockLock or
ClockBoost to acquire lock
40
s
相關(guān)PDF資料
PDF描述
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EP20K200EFI484-2ES 64K, 8K x 8 Bit; 5 Volt, Byte Alterable EEPROM; Temperature Range: -55°C to 125°C; Package: 32-LCC
EP20K200EFI484-3ES FPGA
EP20K200EFI672-1ES FPGA
EP20K200EFI672-2ES FPGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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EP20K200CP240I7ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC
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EP20K200CP240I8ES 制造商:未知廠家 制造商全稱:未知廠家 功能描述:ASIC
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