參數(shù)資料
型號： EP20K160EQI208-3ES
英文描述： 5V, Byte Alterable EEPROM; Temperature Range: 0&degC to 70°C; Package: 32-CerDIP
中文描述： FPGA的
文件頁數(shù)： 94/114頁
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代理商： EP20K160EQI208-3ES
80
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Tables 44 through 46 show the fMAX timing parameters for EP20K100,
EP20K200, and EP20K400 APEX 20K devices. ,
Table 44. EP20K100 fMAX Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Min
Max
Min
Max
Min
Max
tSU
0.5
0.6
0.8
tH
0.7
0.8
1.0
tCO
0.3
0.4
0.5
tLUT
0.8
1.0
1.3
tESBRC
1.7
2.1
2.4
tESBWC
5.7
6.9
8.1
tESBWESU
3.3
3.9
4.6
tESBDATASU
2.2
2.7
3.1
tESBADDRSU
2.4
2.9
3.3
tESBDATACO1
1.3
1.6
1.8
tESBDATACO2
2.6
3.1
3.6
tESBDD
2.5
3.3
3.6
tPD
2.5
3.0
3.6
tPTERMSU
2.3
2.6
3.2
tPTERMCO
1.5
1.8
2.1
tF1-4
0.5
0.6
0.7
tF5-20
1.6
1.7
1.8
tF20+
2.2
2.3
tCH
2.0
2.5
3.0
tCL
2.0
2.5
3.0
tCLRP
0.3
0.4
tPREP
0.5
tESBCH
2.0
2.5
3.0
tESBCL
2.0
2.5
3.0
tESBWP
1.6
1.9
2.2
tESBRP
1.0
1.3
1.4
相關PDF資料
PDF描述
EP20K160EQI240-1ES 5V, Byte Alterable EEPROM; Temperature Range: 0&degC to 70°C; Package: 32-CerDIP
EP20K160EQI240-2ES 5V, Byte Alterable EEPROM; Temperature Range: 0&degC to 70°C; Package: 32-CerDIP
EP20K160EQI240-3ES 5V, Byte Alterable EEPROM; Temperature Range: -55°C to 125°C; Package: 32-CerDIP
EP20K160ERC208-1ES FPGA
EP20K160ERC208-2ES FPGA
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