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參數(shù)資料
| 型號： | EP20K100QI240-3ES |
| 英文描述： | Boost Regulator with Dual Feedback Paths and Output Disconnect for Passive OLED Power Applications; Temperature Range: -40°C to 85°C; Package: 10-DFN T&R |
| 中文描述： | FPGA的 |
| 文件頁數(shù)： | 5/114頁 |
| 文件大小： | 1623K |
| 代理商： | EP20K100QI240-3ES |
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102
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Table 91. EP20K400E fMAX Routing Delays
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tF1-4
0.25
0.26
ns
tF5-20
1.01
1.12
1.25
ns
tF20+
3.71
3.92
4.17
ns
Table 92. EP20K400E Minimum Pulse Width Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tCH
1.36
2.22
2.35
ns
tCL
1.36
2.26
2.35
ns
tCLRP
0.18
0.19
ns
tPREP
0.18
0.19
ns
tESBCH
1.36
2.26
2.35
ns
tESBCL
1.36
2.26
2.35
ns
tESBWP
1.17
1.38
1.56
ns
tESBRP
0.94
1.09
1.25
ns
Table 93. EP20K400E External Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.51
2.64
2.77
ns
tINH
0.00
ns
tOUTCO
2.00
5.25
2.00
5.79
2.00
6.32
ns
tINSUPLL
3.221
3.38
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
2.25
0.50
2.45
-
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K100RI208-1 | Field Programmable Gate Array (FPGA) |
| EP20K100RI208-1ES | FPGA |
| EP20K100RI208-2 | Field Programmable Gate Array (FPGA) |
| EP20K100RI208-2ES | FPGA |
| EP20K100RI208-3 | Field Programmable Gate Array (FPGA) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K100RC208-1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP20K100RC208-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K100RC208-2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP20K100RC208-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K100RC208-3 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
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