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參數(shù)資料
| 型號(hào)： | EP1SGX25GF672C5N |
| 廠商： | ALTERA CORP |
| 元件分類： | FPGA |
| 英文描述： | FPGA, PBGA672 |
| 封裝： | 27 X 27 MM, 1 MM PITCH, LEAD FREE, FBGA-672 |
| 文件頁數(shù)： | 166/279頁 |
| 文件大?。?/td> | 3671K |
| 代理商： | EP1SGX25GF672C5N |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁當(dāng)前第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁第227頁第228頁第229頁第230頁第231頁第232頁第233頁第234頁第235頁第236頁第237頁第238頁第239頁第240頁第241頁第242頁第243頁第244頁第245頁第246頁第247頁第248頁第249頁第250頁第251頁第252頁第253頁第254頁第255頁第256頁第257頁第258頁第259頁第260頁第261頁第262頁第263頁第264頁第265頁第266頁第267頁第268頁第269頁第270頁第271頁第272頁第273頁第274頁第275頁第276頁第277頁第278頁第279頁
6–46
Altera Corporation
Stratix GX Device Handbook, Volume 1
August 2005
Timing Model
1.5-V HSTL class II
0
ps
1.8-V HSTL class I
70
73
83
ps
1.8-V HSTL class II
70
73
83
ps
LVDS (1)
40
42
48
ps
LVPECL (1)
–50
–53
–61
ps
3.3-V PCML (1)
330
346
397
ps
HyperTransport (1)
80
84
96
ps
Table 6–74. Stratix GX I/O Standard Output Delay Adders for Fast Slew Rate on Column Pins (Part 1 of 2)
Standard
-5 Speed Grade
-6 Speed Grade
-7 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
LVCMOS
2 mA
570
599
689
ps
4 mA
570
599
689
ps
8 mA
350
368
423
ps
12 mA
130
137
157
ps
24 mA
0
ps
3.3-V LVTTL
4 mA
570
599
689
ps
8 mA
350
368
423
ps
12 mA
130
137
157
ps
16 mA
70
74
85
ps
24 mA
0
ps
2.5-V LVTTL
2 mA
830
872
1,002
ps
8 mA
250
263
302
ps
12 mA
140
147
169
ps
16 mA
100
105
120
ps
1.8-V LVTTL
2 mA
420
441
507
ps
8 mA
350
368
423
ps
12 mA
350
368
423
ps
1.5-V LVTTL
2 mA
1,740
1,827
2,101
ps
4 mA
1,160
1,218
1,400
ps
8 mA
690
725
833
ps
GTL
–150
–157
–181
ps
Table 6–73. Stratix GX I/O Standard Row Pin Input Delay Adders (Part 2 of 2)
I/O Standard
-5 Speed Grade
-6 Speed Grade
-7 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP1SGX25GF672C6ES | FPGA, PBGA672 |
| EP1SGX25GF672C6N | FPGA, PBGA672 |
| EP1SGX25GF672C7ES | FPGA, PBGA672 |
| EP1SGX25GF672C7N | FPGA, PBGA672 |
| EP1SGX25GF672I5ES | FPGA, PBGA672 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP1SGX40 | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:1. Enhanced Configuration Devices (EPC4, EPC8, and EPC16) Data Sheet |
| EP1SGX40D | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:StratixGX FPGA Family |
| EP1SGX40DF1020C5 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 4125 LABs 624 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1SGX40DF1020C5N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 4125 LABs 624 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1SGX40DF1020C6 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I GX 4125 LABs 624 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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