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參數(shù)資料
| 型號： | EP1S40F780C5 |
| 廠商： | Altera |
| 文件頁數(shù)： | 390/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 40K LE 780-FBGA |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標準包裝： | 18 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 4125 |
| 邏輯元件/單元數(shù)： | 41250 |
| RAM 位總計： | 3423744 |
| 輸入/輸出數(shù)： | 615 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 780-BBGA |
| 供應(yīng)商設(shè)備封裝： | 780-FBGA（29x29） |
| 其它名稱： | 544-1782 |
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Altera Corporation
2–21
July 2005
Stratix Device Handbook, Volume 1
Stratix Architecture
TriMatrix
Memory
TriMatrix memory consists of three types of RAM blocks: M512, M4K,
and M-RAM blocks. Although these memory blocks are different, they
can all implement various types of memory with or without parity,
including true dual-port, simple dual-port, and single-port RAM, ROM,
and FIFO buffers. Table 2–3 shows the size and features of the different
RAM blocks.
Table 2–3. TriMatrix Memory Features (Part 1 of 2)
Memory Feature
M512 RAM Block
(32 × 18 Bits)
M4K RAM Block
(128 ×36Bits)
M-RAM Block
(4K × 144 Bits)
Maximum
performance
True dual-port
memory
vv
Simple dual-port
memory
vv
v
Single-port memory
vv
v
Shift register
vv
ROM
vv
FIFO buffer
vv
v
Byte enable
vv
Parity bits
vv
v
Mixed clock mode
vv
v
Memory initialization
vv
Simple dual-port
memory mixed width
support
vv
v
True dual-port
memory mixed width
support
vv
Power-up conditions
Outputs cleared
Outputs
unknown
Register clears
Input and output
registers
Input and output
registers
Output registers
Mixed-port read-
during-write
Unknown
output/old data
Unknown
output/old data
Unknown output
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