參數(shù)資料
型號： EP1S40F1508C7
廠商： Altera
文件頁數(shù)： 412/864頁
文件大小： 0K
描述： IC STRATIX FPGA 40K LE 1508-FBGA
產(chǎn)品培訓模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標準包裝： 7
系列： Stratix®
LAB/CLB數(shù)： 4125
邏輯元件/單元數(shù)： 41250
RAM 位總計： 3423744
輸入/輸出數(shù)： 822
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1508-BBGA
供應商設備封裝： 1508-FBGA（30x30）
其它名稱： 544-1428
EP1S40SF1508C7
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Altera Corporation
2–23
July 2005
Stratix Device Handbook, Volume 1
Stratix Architecture
In addition to true dual-port memory, the memory blocks support simple
dual-port and single-port RAM. Simple dual-port memory supports a
simultaneous read and write and can either read old data before the write
occurs or just read the don’t care bits. Single-port memory supports non-
simultaneous reads and writes, but the q[] port will output the data once
it has been written to the memory (if the outputs are not registered) or
after the next rising edge of the clock (if the outputs are registered). For
Figure 2–13 shows these different RAM memory port configurations for
TriMatrix memory.
Figure 2–13. Simple Dual-Port & Single-Port Memory Configurations
Note to Figure 2–13:
(1)
Two single-port memory blocks can be implemented in a single M4K block as long
as each of the two independent block sizes is equal to or less than half of the M4K
block size.
The memory blocks also enable mixed-width data ports for reading and
writing to the RAM ports in dual-port RAM configuration. For example,
the memory block can be written in ×1 mode at port A and read out in ×16
mode from port B.
data[]
wraddress[]
wren
inclock
inclocken
inaclr
rdaddress[]
rden
q[]
outclock
outclocken
outaclr
data[]
address[]
wren
inclock
inclocken
inaclr
q[]
outclock
outclocken
outaclr
Single-Port Memory (1)
Simple Dual-Port Memory
相關PDF資料
PDF描述
EP1S40B956C7 IC STRATIX FPGA 40K LE 956-BGA
EMC65DRTS CONN EDGECARD 130POS .100 EXTEND
RBB120DHAN CONN EDGE DUAL .050 R/A 240 POS
RMM40DTAS CONN EDGECARD 80POS R/A .156 SLD
RSC60DRTS-S93 CONN EDGECARD 120PS DIP .100 SLD
相關代理商/技術參數(shù)
參數(shù)描述
EP1S40F1508C7ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S40F1508C7N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 4125 LABs 822 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256
EP1S40F1508I5ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S40F1508I6ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
EP1S40F1508I7ES 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet
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