參數資料
| 型號： | EP1S30F780C8N |
| 廠商： | Altera |
| 文件頁數： | 797/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 30K LE 780-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產品變化通告： | Package Height Change 03/March/2008 |
| 標準包裝： | 18 |
| 系列： | Stratix® |
| LAB/CLB數： | 3247 |
| 邏輯元件/單元數： | 32470 |
| RAM 位總計： | 3317184 |
| 輸入/輸出數： | 597 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 780-BBGA |
| 供應商設備封裝： | 780-FBGA（29x29） |
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12–38
Altera Corporation
Stratix Device Handbook, Volume 2
September 2004
Using Enhanced Configuration Devices
Figure 12–21. Specifying Block Addresses for an Application Configuration
A sample memory map output file for the preceding example is shown
below. Note that the allocated memory for page 1 is between
0x00070000
and 0x000BFFFF, while the actual region used by the
current application configuration bitstream is between 0x0007B144 and
0x000BFFFF
. The configuration data is top justified within the allocated
SOF data region. Similarly, the allocated memory for page 2 is between
0x000D0000
and 0x0012FFFF, while the actual region used by the
application configuration is between 0x000EB13E and 0x0012FFF9.
Also note that the HEX data stored in the main data area uses absolute
addressing. If relative addressing were to be used, the main data contents
would be justified with the top (higher address locations) of the memory.
The initial POF can be converted to an Intel Hexadecimal format file
(*.HEXOUT) using the Quartus II CPF utility. See Figure 12–22.
Block
Start Address
End Address
BOTTOM BOOT
0x00000000
0x000001FF
OPTION BITS
0x00010000
0x0001003F
PAGE 0
0x00010040
0x00054EFA
PAGE 1
0x0007B144
0x000BFFFF
PAGE 2
0x000EB13E
0x0012FFF9
TOP BOOT/MAIN
0x001F0000
0x001F01FF
相關PDF資料 |
PDF描述 |
|---|---|
| EP2SGX30CF780C4 | IC STRATIX II GX 30K 780-FBGA |
| A1240A-1PQ144I | IC FPGA 4K GATES 144-PQFP IND |
| A1240A-1PQG144I | IC FPGA 4K GATES 144-PQFP IND |
| EP1AGX50DF1152I6N | IC ARRIA GX FPGA 50K 1152FBGA |
| AGLE3000V2-FGG896 | IC FPGA 1KB FLASH 3M 896-FBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP1S30F780I6 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S30F780I6N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S-3G1 | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G1T | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
| EP1S-3G1TT | 制造商:NEC 制造商全稱:NEC 功能描述:LOW SOUND PRESSURE |
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