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Altera Corporation
6–1
July 2005
6. DSP Blocks in Stratix &
Stratix GX Devices
Introduction
Traditionally, designers had to make a trade-off between the flexibility of
off-the-shelf digital signal processors and the performance of custom-
built devices. Altera Stratix and Stratix GX devices eliminate the need
for this trade-off by providing exceptional performance combined with
the flexibility of programmable logic devices (PLDs). Stratix and
Stratix GX devices have dedicated digital signal processing (DSP) blocks,
which have high-speed parallel processing capabilities, that are
optimized for DSP applications. DSP blocks are ideal for implementing
DSP applications that need high data throughput.
The most commonly used DSP functions are finite impulse response (FIR)
filters, complex FIR filters, infinite impulse response (IIR) filters, fast
Fourier transform (FFT) functions, discrete cosine transform (DCT)
functions, and correlators. These functions are the building blocks for
more complex systems such as wideband code division multiple access
(W-CDMA) basestations, voice over Internet protocol (VoIP), and high-
definition television (HDTV).
Although these functions are complex, they all use similar building
blocks such as multiply-adders and multiply-accumulators. Stratix and
Stratix GX DSP blocks combine five arithmetic operations—
multiplication, addition, subtraction, accumulation, and summation—to
meet the requirements of complex functions and to provide improved
performance.
This chapter describes the Stratix and Stratix GX DSP blocks, and
explains how you can use them to implement high-performance DSP
functions. It addresses the following topics:
■
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f
See the Stratix Device Family Data Sheet section of the Stratix Device
Handbook, Volume 1 and the Stratix GX Device Family Data Sheet section of
the Stratix GX Device Handbook, Volume 1 for more information on Stratix
and Stratix GX devices, respectively.
S52006-2.2
相關(guān)PDF資料 |
PDF描述 |
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| EP1S30F780C7N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S30F780C8 | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP1S30F780C8N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix I 3247 LABs 597 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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