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參數(shù)資料
| 型號(hào)： | EP1S30B956C7 |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 407/864頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 30K LE 956-BGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 7 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 3247 |
| 邏輯元件/單元數(shù)： | 32470 |
| RAM 位總計(jì)： | 3317184 |
| 輸入/輸出數(shù)： | 683 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 956-BGA |
| 供應(yīng)商設(shè)備封裝： | 956-BGA覆晶式（40x40） |
| 其它名稱： | 544-1418 EP1S30SB956C7 |
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Altera Corporation
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June 2006
Stratix Device Handbook, Volume 2
Selectable I/O Standards in Stratix & Stratix GX Devices
Figure 4–22. Current Draw Limitation Guidelines
Any 10 consecutive I/O pads cannot exceed 200 mA in thermally
enhanced FineLine BGA and thermally enhanced BGA cavity up
packages or 164 mA in non-thermally enhanced cavity up and non-
thermally enhanced FineLine BGA packages.
For example, consider a case where a group of 10 consecutive pads are
configured as follows for a thermally enhanced FineLine BGA and
thermally enhanced BGA cavity up package:
■
Number of SSTL-3 Class I output pads = 3
■
Number of GTL+ output pads = 4
■
The rest of the surrounding I/O pads in the consecutive group of 10
are unused
In this case, the total current draw for these 10 consecutive I/O pads
would be:
(# of SSTL-3 Class I pads
× 8 mA) +
(# of GTL+ output pads
× 34 mA) = (3 × 8 mA) + (4 × 34 mA) = 160 mA
In the above example, the total current draw for all 10 consecutive I/O
pads is less than 200 mA.
GND
VCC
I/O Pin Sequence
of an I/O Bank
Any 10 Consecutive I/O Pins,
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。