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參數(shù)資料
| 型號： | EP1S25F1020I6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 68/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 25K LE 1020-FBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標(biāo)準(zhǔn)包裝： | 8 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 2566 |
| 邏輯元件/單元數(shù)： | 25660 |
| RAM 位總計(jì)： | 1944576 |
| 輸入/輸出數(shù)： | 706 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 100°C |
| 封裝/外殼： | 1020-BBGA |
| 供應(yīng)商設(shè)備封裝： | 1020-FBGA（33x33） |
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Section I–6
Altera Corporation
Stratix Device Family Data Sheet
Stratix Device Handbook, Volume 1
4
● Updated Table 4–123 on page 4–85 through Table 4–126 on
● Updated Note 3 in Table 4–123 on page 4–85.
● Table 4–125 on page 4–88: moved to correct order in chapter, and
updated table.
● Updated Table 4–126 on page 4–92.
● Updated Table 4–127 on page 4–94.
● Updated Table 4–128 on page 4–95.
April 2004, v3.0
● Table 4–129 on page 4–96: updated table and added Note 10.
● Updated Table 4–131 and Table 4–132 on page 4–100.
● Updated Table 4–110 on page 4–74.
● Updated Table 4–123 on page 4–85.
● Updated Table 4–124 on page 4–87. through Table 4–126 on
● Added Note 10 to Table 4–129 on page 4–96.
● Moved Table 4–127 on page 4–94 to correct order in the chapter.
● Updated Table 4–131 on page 4–100 through Table 4–132 on
● Waveform was added to Figure 4–6.
● The minimum and maximum duty cycle values in Note 3 of Table 4–8
were moved to a new Table 4–9.
● Changes were made to values in SSTL-3 Class I and II rows in
● Note 1 was added to Table 4–34.
● Changed Table 4–55 title from “EP1S10 Column Pin Fast Regional
Clock External I/O Timing Parameters” to “EP1S10 External I/O
Timing on Column Pins Using Fast Regional Clock Networks.”
● Changed values in Tables 4–46, 4–48 to 4–51, 4–128, and 4–131.
● Deleted -5 Speed Grade column in Tables 4–117 to 4–119 and 4–122
to 4–123.
● Fixed differential waveform in Figure 4–1.
● Added “Definition of I/O Skew” section.
● Added tSU and tCO_C rows and made changes to values in tPRE and
● Added Table 4–51 to “Internal Timing Parameters” section.
● The timing information is preliminary in Tables 4–55 through 4–96.
November 2003, v2.2
● Updated Tables 4–127 through 4–129.
Chapter
Date/Version
Changes Made
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HSM43DSAH | CONN EDGECARD 86POS R/A .156 SLD |
| HMM43DSAH | CONN EDGECARD 86POS R/A .156 SLD |
| M24308/2-299 | CONN D-SUB RCPT HD 44P SER 90 |
| EMC60DRYN-S734 | CONN EDGECARD 120PS DIP .100 SLD |
| EMC60DRYH-S734 | CONN EDGECARD 120PS DIP .100 SLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP1S25F1508C5ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25F1508C6ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25F1508C7ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25F1508I5ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
| EP1S25F1508I6ES | 制造商:ALTERA 制造商全稱:Altera Corporation 功能描述:Stratix Device Family Data Sheet |
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