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參數(shù)資料
| 型號： | EP1S25F1020C6N |
| 廠商： | Altera |
| 文件頁數(shù)： | 764/864頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC STRATIX FPGA 25K LE 1020-FBGA |
| 產(chǎn)品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 產(chǎn)品變化通告： | Package Height Change 03/March/2008 |
| 標準包裝： | 8 |
| 系列： | Stratix® |
| LAB/CLB數(shù)： | 2566 |
| 邏輯元件/單元數(shù)： | 25660 |
| RAM 位總計： | 1944576 |
| 輸入/輸出數(shù)： | 706 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 1020-BBGA |
| 供應商設備封裝： | 1020-FBGA（33x33） |
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Altera Corporation
12–9
September 2004
Stratix Device Handbook, Volume 2
Remote System Configuration with Stratix & Stratix GX Devices
Figure 12–6. Remote Configuration Registers & Related Data Path
Table 12–3 describes the user configuration signals that are driven
to/from the device logic array. The remote configuration logic has one
input signal to the device logic array and six output signals from the
device logic array.
Status Register
Control Register
Update Register
Logic
Shift Register
Control Logic
to Reconfig Logic
User
Watchdog
Timer
RU_Dout
RU_shftnhld
RU_captnupdt
RU_Din
RU_clk
RU_Timer
RU_nCONFIG
Device Core
Bit4...Bit10
Bit16...Bit0
Bit0...Bit16
Table 12–3. User Configuration Signals To/From Device Core (Part 1 of 2)
Signal Name
To/From Device Core
Description
RU_Timer
Output from the core to the
remote update block
Request from the application to reset the user watchdog
timer with its initial count. A falling edge of this signal
triggers a reset of the user watchdog timer.
RU_nCONFIG
Output from the core to the
remote update block
When driven low, this signal triggers the device to
reconfigure. If requested by the factory configuration, the
application configuration specified in the remote update
control register is loaded. If requested by the application
configuration, the factory configuration is loaded.
RU_Clk
Output from the core to the
remote update block
Clocks the remote configuration shift register so that the
contents of the status and control registers can be read
out, and the contents of update register can be loaded.
The shift register latches data on the rising edge of the
RU_Clk
.
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