參數(shù)資料
型號： EP1S20F484C5N
廠商： Altera
文件頁數(shù)： 504/864頁
文件大小： 0K
描述： IC STRATIX FPGA 20K LE 484-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
產(chǎn)品變化通告： Package Height Change 03/March/2008
標(biāo)準(zhǔn)包裝： 20
系列： Stratix®
LAB/CLB數(shù)： 1846
邏輯元件/單元數(shù)： 18460
RAM 位總計(jì)： 1669248
輸入/輸出數(shù)： 361
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA（23x23）
6–2
Altera Corporation
Stratix Device Handbook, Volume 2
July 2005
DSP Block Overview
DSP Block
Overview
Each Stratix and Stratix GX device has two columns of DSP blocks that
efficiently implement multiplication, multiply accumulate (MAC), and
filtering functions. Figure 6–1 shows one of the columns with
surrounding LAB rows. You can configure each DSP block to support:
■
Eight 9
× 9 bit multipliers
■
Four 18
× 18 bit multipliers
■
One 36
× 36 bit multiplier
Figure 6–1. DSP Blocks Arranged in Columns
The multipliers can then feed an adder or an accumulator block,
depending on the DSP block operational mode. Additionally, you can use
the DSP block input registers as shift registers to implement applications
such as FIR filters efficiently. The number of DSP blocks per column
DSP Block
Column
8 LAB
Rows
DSP Block
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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