參數(shù)資料
型號： EP1K50FI256-2P
英文描述： Field Programmable Gate Array (FPGA)
中文描述： 現(xiàn)場可編程門陣列（FPGA）
文件頁數(shù)： 73/86頁
文件大?。?/td> 1263K
代理商： EP1K50FI256-2P
Altera Corporation
75
ACEX 1K Programmable Logic Device Family Data Sheet
Development
13
Tools
Notes to tables:
(1)
All timing parameters are described in Tables 22 through 29.
(2)
This parameter is measured without use of the ClockLock or ClockBoost circuits.
(3)
This parameter is measured with use of the ClockLock or ClockBoost circuits
Table 50. EP1K50 External Bidirectional Timing Parameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tINSUBIDIR (2)
2.7
3.2
4.3
ns
tINHBIDIR (2)
0.0
ns
tINSUBIDIR (3)
3.7
4.2
–
ns
tINHBIDIR (3)
0.0
–
ns
tOUTCOBIDIR (2)
2.0
4.5
2.0
5.2
2.0
7.3
ns
tXZBIDIR (2)
6.8
7.8
10.1
ns
tZXBIDIR (2)
6.8
7.8
10.1
ns
tOUTCOBIDIR (3)
0.5
3.5
0.5
4.2
––
tXZBIDIR (3)
6.8
8.4
–
ns
tZXBIDIR (3)
6.8
8.4
–
ns
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PDF描述
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