參數(shù)資料
型號(hào)： EP1K50FI256-1F
英文描述： Dual LDO with Low Noise, Low IQ, and High PSRR; Temperature Range: -40°C to 85°C; Package: 10-DFN
中文描述： 現(xiàn)場可編程門陣列（FPGA）
文件頁數(shù)： 59/86頁
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代理商： EP1K50FI256-1F
62
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Table 32. EP1K10 Device EAB Internal Microparameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tEABDATA1
1.8
1.9
ns
tEABDATA2
0.6
0.7
ns
tEABWE1
1.2
ns
tEABWE2
0.4
ns
tEABRE1
0.9
ns
tEABRE2
0.4
ns
tEABCLK
0.0
ns
tEABCO
0.3
ns
tEABBYPASS
0.5
0.6
ns
tEABSU
1.0
ns
tEABH
0.5
0.4
ns
tEABCLR
0.3
ns
tAA
3.4
3.6
ns
tWP
2.7
2.8
ns
tRP
1.0
ns
tWDSU
1.0
ns
tWDH
0.1
ns
tWASU
1.8
1.9
ns
tWAH
1.9
2.0
ns
tRASU
3.1
3.5
ns
tRAH
0.2
ns
tWO
2.7
2.8
ns
tDD
2.7
2.8
ns
tEABOUT
0.5
0.6
ns
tEABCH
1.5
2.0
ns
tEABCL
2.7
2.8
ns
相關(guān)PDF資料
PDF描述
EP1K50FI256-1P Dual LDO with Low Noise, Low IQ, and High PSRR; Temperature Range: -40°C to 85°C; Package: 10-DFN
EP1K50FI256-1X Field Programmable Gate Array (FPGA)
EP1K50FI256-2DX Field Programmable Gate Array (FPGA)
EP1K50FI256-2P Field Programmable Gate Array (FPGA)
EP1K50FI256-2X Field Programmable Gate Array (FPGA)
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參數(shù)描述
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