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參數(shù)資料
| 型號(hào)： | EP1K50FC484-1X |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場(chǎng)可編程門陣列（FPGA） |
| 文件頁(yè)數(shù)： | 71/86頁(yè) |
| 文件大小： | 1263K |
| 代理商： | EP1K50FC484-1X |
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Altera Corporation
73
ACEX 1K Programmable Logic Device Family Data Sheet
Development
13
Tools
Table 47. EP1K50 Device EAB Internal Timing Macroparameters
Symbol
Speed Grade
Unit
-1
-2
-3
Min
Max
Min
Max
Min
Max
tEABAA
3.7
5.2
7.0
ns
tEABRCCOMB
3.7
5.2
7.0
ns
tEABRCREG
3.5
4.9
6.6
ns
tEABWP
2.0
2.8
3.8
ns
tEABWCCOMB
4.5
6.3
8.6
ns
tEABWCREG
5.6
7.8
10.6
ns
tEABDD
3.8
5.3
7.2
ns
tEABDATACO
0.8
1.1
1.5
ns
tEABDATASU
1.1
1.6
2.1
ns
tEABDATAH
0.0
ns
tEABWESU
0.7
1.0
1.3
ns
tEABWEH
0.4
0.6
0.8
ns
tEABWDSU
1.2
1.7
2.2
ns
tEABWDH
0.0
ns
tEABWASU
1.6
2.3
3.0
ns
tEABWAH
0.9
1.2
1.8
ns
tEABWO
3.1
4.3
5.9
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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