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參數(shù)資料
| 型號(hào)： | EP1K50FC256-2P |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA） |
| 文件頁(yè)數(shù)： | 41/86頁(yè) |
| 文件大?。?/td> | 1263K |
| 代理商： | EP1K50FC256-2P |
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46
Altera Corporation
ACEX 1K Programmable Logic Device Family Data Sheet
Table 19. ACEX 1K Device Recommended Operating Conditions
Symbol
Parameter
Conditions
Min
Max
Unit
VCCINT
Supply voltage for internal logic
and input buffers
2.375
(2.375)
2.625
(2.625)
V
VCCIO
Supply voltage for output buffers,
3.3-V operation
3.00 (3.00)
3.60 (3.60)
V
Supply voltage for output buffers,
2.5-V operation
2.375
(2.375)
2.625
(2.625)
V
VI
Input voltage
–0.5
5.75
V
VO
Output voltage
0
VCCIO
V
TA
Ambient temperature
For commercial use
0
70
°
C
For industrial use
–40
85
°
C
TJ
Operating temperature
For commercial use
0
85
°
C
For industrial use
–40
100
°
C
tR
Input rise time
40
ns
tF
Input fall time
40
ns
Table 20. ACEX 1K Device DC Operating Conditions (Part 1 of 2)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIH
High-level input voltage
1.7,
0.5
× VCCIO (8)
5.75
V
VIL
Low-level input voltage
–0.5
0.8,
0.3
× VCCIO (8)
V
VOH
3.3-V high-level TTL output
voltage
IOH = –8 mA DC,
2.4
V
3.3-V high-level CMOS output
voltage
IOH = –0.1 mA DC,
VCCIO – 0.2
V
3.3-V high-level PCI output
voltage
IOH = –0.5 mA DC,
VCCIO = 3.00 to 3.60 V
0.9
×VCCIO
V
2.5-V high-level output voltage IOH = –0.1 mA DC,
2.1
V
IOH = –1 mA DC,
2.0
V
IOH = –2 mA DC,
1.7
V
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PDF描述 |
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