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參數資料
| 型號： | EDD2508AKTA-5C-E |
| 廠商： | ELPIDA MEMORY INC |
| 元件分類： | DRAM |
| 英文描述： | 256M bits DDR SDRAM (32M words x 8 bits, DDR400) |
| 中文描述： | 32M X 8 DDR DRAM, 0.7 ns, PDSO66 |
| 封裝： | ROHS COMPLIANT, PLASTIC, TSOP2-66 |
| 文件頁數： | 36/48頁 |
| 文件大?。?/td> | 551K |
| 代理商： | EDD2508AKTA-5C-E |
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EDD2508AKTA-5-E
Preliminary Data Sheet E0609E20 (Ver. 2.0)
36
A Write command to the consecutive Precharge command interval (same bank)
The minimum interval tWPD is necessary between the write command and the precharge command.
in0
in1
in2
in3
CK
/CK
DQ
DM
DQS
Command
t1
t0
t2
t3
t4
t5
t6
t7
Last data input
tWPD
WRIT
NOP
tWR
PRE/PALL
NOP
WRITE to PRECHARGE Command Interval (same bank) (BL = 4)
Precharge Termination in Write Cycles
During a burst write cycle without auto precharge, the burst write operation is terminated by a precharge command
of the same bank. In order to write the last input data, tWR (min) must be satisfied. When the precharge command
is issued, the invalid data must be masked by DM.
in2
in3
in0
in1
CK
/CK
DQ
DM
DQS
Command
t1
t0
t2
t3
t4
t5
t6
t7
Data masked
WRIT
NOP
NOP
tWR
PRE/PALL
Precharge Termination in Write Cycles (same bank) (BL = 4)
相關PDF資料 |
PDF描述 |
|---|---|
| EDD2508AKTA-5 | 256M bits DDR SDRAM (32M words x 8 bits, DDR400) |
| EDD2508AKTA-5B | 256M bits DDR SDRAM (32M words x 8 bits, DDR400) |
| EDD2508AKTA-5C | 256M bits DDR SDRAM (32M words x 8 bits, DDR400) |
| EDD2516AETA-7A-E | 256M bits DDR SDRAM |
| EDD2508AETA | 256M bits DDR SDRAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EDD2508AKTA-5-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M bits DDR SDRAM (32M words x 8 bits, DDR400) |
| EDD2508AKTA-6B | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M bits DDR SDRAM |
| EDD2508AKTA-6B-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M bits DDR SDRAM |
| EDD2508AKTA-6BLI | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M bits DDR SDRAM WTR (Wide Temperature Range) |
| EDD2508AKTA-E | 制造商:ELPIDA 制造商全稱:Elpida Memory 功能描述:256M bits DDR SDRAM |
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