• 參數(shù)資料
    型號: DSPIC30F4011-20E/ML
    廠商: Microchip Technology
    文件頁數(shù): 71/238頁
    文件大?。?/td> 0K
    描述: IC DSPIC MCU/DSP 48K 44QFN
    產(chǎn)品培訓模塊: Asynchronous Stimulus
    標準包裝: 45
    系列: dsPIC™ 30F
    核心處理器: dsPIC
    芯體尺寸: 16-位
    速度: 20 MIPS
    連通性: CAN,I²C,SPI,UART/USART
    外圍設備: 高級欠壓探測/復位,電機控制 PWM,QEI,POR,PWM,WDT
    輸入/輸出數(shù): 30
    程序存儲器容量: 48KB(16K x 24)
    程序存儲器類型: 閃存
    EEPROM 大?。?/td> 1K x 8
    RAM 容量: 2K x 8
    電壓 - 電源 (Vcc/Vdd): 2.5 V ~ 5.5 V
    數(shù)據(jù)轉(zhuǎn)換器: A/D 9x10b
    振蕩器型: 內(nèi)部
    工作溫度: -40°C ~ 125°C
    封裝/外殼: 44-VQFN 裸露焊盤
    包裝: 管件
    其它名稱: DSPIC30F401120EML
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    dsPIC30F4011/4012
    DS70135G-page 162
    2010 Microchip Technology Inc.
    Any interrupt that is individually enabled (using the
    corresponding IE bit) and meets the prevailing priority
    level can wake-up the processor. The processor
    processes the interrupt and branches to the ISR. The
    SLEEP status bit in the RCON register is set upon
    wake-up.
    All Resets wake-up the processor from Sleep mode.
    Any Reset, other than POR, sets the SLEEP status bit.
    In a POR, the SLEEP bit is cleared.
    If Watchdog Timer is enabled, the processor wakes-up
    from Sleep mode upon WDT time-out. The SLEEP and
    WDTO status bits are both set.
    21.5.2
    IDLE MODE
    In Idle mode, the clock to the CPU is shut down while
    peripherals keep running. Unlike Sleep mode, the clock
    source remains active.
    Several peripherals have a control bit in each module,
    that allows them to operate during Idle.
    LPRC Fail-Safe Clock Monitor remains active if clock
    failure detect is enabled.
    The processor wakes up from Idle if at least one of the
    following conditions is true:
    Any interrupt that is individually enabled (IE bit is
    ‘1’) and meets the required priority level
    Any Reset (POR, BOR, MCLR)
    WDT time-out
    Upon wake-up from Idle mode, the clock is re-applied
    to
    the
    CPU
    and
    instruction
    execution
    begins
    immediately, starting with the instruction following the
    PWRSAV
    instruction.
    Any interrupt that is individually enabled (using IE bit)
    and meets the prevailing priority level can wake-up the
    processor. The processor processes the interrupt and
    branches to the ISR. The IDLE status bit in RCON
    register is set upon wake-up.
    Any Reset, other than POR, sets the IDLE status bit.
    On a POR, the IDLE bit is cleared.
    If Watchdog Timer is enabled, then the processor
    wakes-up from Idle mode upon WDT time-out. The
    IDLE and WDTO status bits are both set.
    Unlike wake-up from Sleep, there are no time delays
    involved in wake-up from Idle.
    21.6
    Device Configuration Registers
    The Configuration bits in each device Configuration
    register specify some of the device modes and are
    programmed by a device programmer, or by using the
    In-Circuit Serial Programming (ICSP) feature of the
    device. Each device Configuration register is a 24-bit
    register, but only the lower 16 bits of each register are
    used to hold configuration data. There are five device
    Configuration registers available to the user:
    1.
    FOSC (0xF80000): Oscillator Configuration
    Register
    2.
    FWDT (0xF80002): Watchdog Timer
    Configuration Register
    3.
    FBORPOR (0xF80004): BOR and POR
    Configuration Register
    4.
    FGS (0xF8000A): General Code Segment
    Configuration Register
    5.
    FICD (0xF8000C): Debug Configuration
    Register
    The placement of the Configuration bits is automatically
    handled when you select the device in your device
    programmer. The desired state of the Configuration bits
    may be specified in the source code (dependent on the
    language tool used), or through the programming
    interface. After the device has been programmed, the
    application software may read the Configuration bit
    values through the table read instructions. For additional
    information,
    please
    refer
    to
    the
    programming
    specifications of the device.
    Note:
    In spite of various delays applied (TPOR,
    TLOCK and TPWRT), the crystal oscillator
    (and PLL) may not be active at the end of
    the time-out (e.g., for low-frequency crys-
    tals). In such cases, if FSCM is enabled,
    the device detects this condition as a
    clock failure and processes the clock fail-
    ure trap. The FRC oscillator is enabled,
    and the user must re-enable the crystal
    oscillator. If FSCM is not enabled, then the
    device simply suspends execution of code
    until the clock is stable and remains in
    Sleep until the oscillator clock has started.
    Note:
    If the code protection Configuration fuse
    bits
    (FGS<GCP>
    and
    FGS<GWRP>)
    have been programmed, an erase of the
    entire
    code-protected
    device
    is
    only
    possible at voltages VDD
    ≥ 4.5V.
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    DSPIC30F4011-20I/ML 制造商:Microchip Technology Inc 功能描述:16- Bit Digital Signal Controller Memory
    DSPIC30F4011-20I/P 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16bit Signal Cntrlr RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
    DSPIC30F4011-20I/P 制造商:Microchip Technology Inc 功能描述:16BIT MCU-DSP 20MHZ 30F4011 DIP40
    DSPIC30F4011-20I/PT 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16 Bit MCU/DSP 20M 48KB FL RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT