參數(shù)資料
型號(hào)： DSP56311VF150B1
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 25/96頁(yè)
文件大小： 0K
描述： IC DSP 24BIT 150MHZ 196-BGA
標(biāo)準(zhǔn)包裝： 630
系列： DSP56K/Symphony
類型： 定點(diǎn)
接口： 主機(jī)接口，SSI，SCI
時(shí)鐘速率： 150MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 384kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 100°C
安裝類型： 表面貼裝
封裝/外殼： 196-LBGA
供應(yīng)商設(shè)備封裝： 196-MAPBGA（15x15）
包裝： 托盤
AC Electrical Characteristics
DSP56311 Technical Data, Rev. 8
Freescale Semiconductor
2-11
2.4.5
External Memory Expansion Port (Port A)
2.4.5.1 SRAM Timing
Figure 2-9.
External Memory Access (DMA Source) Timing
Table 2-8.
SRAM Timing
No.
Characteristics
Symbol
Expression1
150 MHz
Unit
Min
Max
100
Address valid and AA assertion pulse width2
tRC, tWC
(WS + 2)
× T
C 4.0
[2
≤WS ≤7]
(WS + 3)
× TC 4.0
[WS
≥ 8]
22.7
69.3
—
ns
101
Address and AA valid to WR assertion
tAS
0.75
× TC – 3.0
[2
≤WS ≤3]
1.25
× TC – 3.0
[WS
≥ 4]
2.0
5.3
—
ns
102
WR assertion pulse width
tWP
WS
× TC 4.0
[2
≤WS ≤3]
(WS
0.5) × T
C 4.0
[WS
≥ 4]
9.3
19.3
—
ns
103
WR deassertion to address not valid
tWR
1.25
× T
C 4.0
[2
≤WS ≤7]
2.25
× TC 4.0
[WS
≥ 8]
4.3
11.0
—
ns
104
Address and AA valid to input data valid
tAA, tAC
(WS + 0.75)
× TC 6.5
[WS
≥ 2]
—11.8
ns
105
RD assertion to input data valid
tOE
(WS + 0.25)
× TC 6.5
[WS
≥ 2]
—8.5
ns
106
RD deassertion to data not valid (data hold time)
tOHZ
0.0
—
ns
107
Address valid to WR deassertion2
tAW
(WS + 0.75)
× TC 4.0
[WS
≥ 2]
14.3
—
ns
108
Data valid to WR deassertion (data set-up time)
tDS (tDW)(WS 0.25) × TC 5.4
[WS
≥ 2]
6.3
—
ns
109
Data hold time from WR deassertion
tDH
1.25
× TC 4.0
[2
≤WS ≤7]
2.25
× T
C 4.0
[WS
≥ 8]
4.3
11.0
—
ns
110
WR assertion to data active
—
0.25
× T
C 4.0
[2
≤WS ≤3]
–0.25
× TC 4.0
[WS
≥ 4]
–2.4
–5.7
—
ns
29
DMA Source Address
First Interrupt Instruction Execution
A[0–17]
RD
WR
IRQA, IRQB,
IRQC, IRQD,
NMI
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PDF描述
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