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參數(shù)資料
| 型號(hào)： | DS3172 |
| 英文描述： | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| 中文描述： | 單/雙/三/四路、DS3/E3單芯片收發(fā)器 |
| 文件頁(yè)數(shù)： | 145/232頁(yè) |
| 文件大小： | 2133K |
| 代理商： | DS3172 |
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DS3171/DS3172/DS3173/DS3174
145 of 232
Register Name:
Register Description:
Register Address:
Bit #
Name
Default
Bit #
Name
Default
Bit 2: Transmit Driver Monitor Latched Status Interrupt Enable (TDMIE)
The interrupt pin will be driven when
this bit is enabled and the
PORT.SRL
.TDML bit is set and the bit in
GL.ISRIE
.PSRIE[4:1] that corresponds to this
port is enabled.
PORT.SRIE
Port Status Register Interrupt Enable
(0,2,4,6)56h
15
--
0
7
--
0
14
--
0
6
--
0
13
--
0
5
--
0
12
--
0
4
--
0
11
--
0
3
--
0
10
--
0
2
9
--
0
1
8
--
0
0
TDMIE
0
RLOLIE
0
PMSIE
0
Bit 1: Receive Loss Of Lock Latched Status Interrupt Enable (RLOLIE)
The interrupt pin will be driven when
this bit is enabled and the
PORT.SRL
.RLOLL bit is set and the bit in
GL.ISRIE
.PSRIE[4:1] that corresponds to this
port is enabled.
Bit 0: Performance Monitoring Update Latched Status Interrupt Enable (PMSIE)
The interrupt pin will be
driven when this bit is enabled and the
PORT.SRL
.PMSL bit is set and the bit in
GL.ISRIE
.PSRIE[4:1] that
corresponds to this port is enabled.
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PDF描述 |
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