參數(shù)資料
型號： DS21FT40
廠商： DALLAS SEMICONDUCTOR
元件分類： Digital Transmission Controller
英文描述： DATACOM, FRAMER, PBGA300
封裝： BGA-300
文件頁數(shù)： 58/87頁
文件大?。?/td> 386K
代理商： DS21FT40
DS21FT40
61 of 87
RHFR: RECEIVE HDLC FIFO REGISTER (Address=B4 Hex)
(MSB)
(LSB)
HDLC7
HDLC6
HDLC5
HDLC4
HDLC3
HDLC2
HDLC1
HDLC0
SYMBOLS
POSITION
NAME AND DESCRIPTION
HDLC7
RHFR.7
HDLC Data Bit 7. MSB of a HDLC packet data byte.
HDLC6
RHFR.6
HDLC Data Bit 6.
HDLC5
RHFR.5
HDLC Data Bit 5.
HDLC4
RHFR.4
HDLC Data Bit 4.
HDLC3
RHFR.3
HDLC Data Bit 3.
HDLC2
RHFR.2
HDLC Data Bit 2.
HDLC1
RHFR.1
HDLC Data Bit 1.
HDLC0
RHFR.0
HDLC Data Bit 0. LSB of a HDLC packet data byte.
THIR: TRANSMIT HDLC INFORMATION REGISTER (Address=B6 Hex)
(MSB)
(LSB)
–––
––
EMPTY
TFULL
UDR
SYMBOLS
POSITION
NAME AND DESCRIPTION
–
THIR.7
Not Assigned. Could be any value when read.
–
THIR.6
Not Assigned. Could be any value when read.
–
THIR.5
Not Assigned. Could be any value when read.
–
THIR.4
Not Assigned. Could be any value when read.
–
THIR.3
Not Assigned. Could be any value when read.
TEMPTY
THIR.2
Transmit FIFO Empty. A real–time bit that is set high when
the FIFO is empty.
TFULL
THIR.1
Transmit FIFO Full. A real–time bit that is set high when the
FIFO is full.
UDR
THIR.0
Underrun. Set when the transmit FIFO unwantedly empties
out and an abort is automatically sent.
NOTE:
The UDR bit is latched and will be cleared when read.
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