(0°C TO 70°C; VDD=5V±10%) PARAMETER" />
參數(shù)資料
型號(hào)： DS2175S+T&R
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 11/12頁(yè)
文件大?。?/td> 0K
描述： IC ELASTIC STORE T1/CEPT 16-SOIC
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1,000
類型： 存儲(chǔ)器
Tx/Rx類型： T1/CEPT
延遲時(shí)間： 100ns
電容 - 輸入： 5pF
電源電壓： 4.5 V ~ 5.5 V
電流 - 電源： 9mA
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.295"，7.50mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC W
包裝： 帶卷 (TR)
DS2175
8 of 12
AC ELECTRICAL CHARACTERISTICS
(0°C TO 70°C; VDD=5V±10%)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
RCLK Period
tRCLK
200
ns
RCLK, SYSCLK Rise and
Fall Times
tR, tF
20
ns
RCLK Pulse Width
tRWH,
tRWL
100
ns
SYSCLK Pulse Width
tSWH,
tSWL
100
ns
SYSCLK Period
tSYSCLK
200
ns
RMSYNC Setup to RCLK
Falling
tSC
20
tRWH-5
ns
SFSYNC Setup to
SYSCLK Falling
tSC
20
tSWH-5
ns
RMSYNC, SFSYNC,
ALN Pulse Width
tPW
50
ns
RSER Setup from RCLK
Falling
tSD
50
ns
RSER Hold from RCLK
Falling
tHD
50
ns
Propagation Delay
SYSCLK to SSER
tPVD
75
ns
Propagation Delay
SYSCLK to SMSYNC
High
tPSS
75
ns
Propagation Delay
SYSCLK or RCLK to
SLIP Low, FSD
Low/High
tPS
100
ns
ALN Setup to SFSYNC
Rising
tSR
500
ns
NOTES:
1. Measured at VIH =2.0V, VIL –0.8V, and 10 ns maximum rise and fall times.
2. Output load capacitance = 100 pF.
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PDF描述
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