參數(shù)資料
型號： DS2174QN+
廠商： Maxim Integrated Products
文件頁數(shù)： 2/24頁
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描述： IC BERT ENHANCED 44-PLCC
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 26
功能： 增強(qiáng)型位誤碼率測試器（EBERT）
接口： E1，J1，T1
電路數(shù)： 1
電源電壓： 3 V ~ 3.6 V
電流 - 電源： 50mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應(yīng)商設(shè)備封裝： 44-PLCC（16.59x16.59）
包裝： 管件
包括： 錯誤計(jì)數(shù)器，樣式發(fā)生器和檢測器
DS2174
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2. PARALLEL CONTROL INTERFACE
Access to the registers is provided through a nonmultiplexed parallel port. The data bus is 8 bits wide; the
address bus is 4 bits wide. Control registers are accessed directly; memory for long repetitive patterns is
accessed indirectly. RCLK and TCLK are used to update counters and for all rising edge bits in the
register map (RSYNC, LC, TL, SBE). At slow clock rates, sufficient time must be allowed for these port
operations.
Table 2-A. Register Map
ADDRESS
R/W
REGISTER NAME
00
R/W
Control Register 1
01
R/W
Control Register 2
02
R/W
Control Register 3
03
R/W
Control Register 4
04
R
Status Register
05
R/W
Tap/Seed Register 0
06
R/W
Tap/Seed Register 1
07
R/W
Tap/Seed Register 2
08
R/W
Tap/Seed Register 3
09
R/W
TEST Register
0A
R
Count Register 0
0B
R
Count Register 1
0C
R
Count Register 2
0D
R
Count Register 3
0E
R
Count Register 4
0F
R
Count Register 5
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PDF描述
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