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參數(shù)資料
| 型號： | DS2141A |
| 廠商： | DALLAS SEMICONDUCTOR |
| 元件分類： | Digital Transmission Controller |
| 英文描述： | DATACOM, FRAMER, PDIP40 |
| 封裝： | 0.600 INCH, DIP-40 |
| 文件頁數(shù)： | 4/39頁 |
| 文件大?。?/td> | 470K |
| 代理商： | DS2141A |
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DS2141A
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LOCAL LOOPBACK
When CCR1.0 is set to a 1, the DS2141A will enter a Local LoopBack (LLB) mode. This loopback is
useful in testing and debugging applications. In LLB, the DS2141A will loop data from the transmit side
back to the receive side. This loopback is synonymous with replacing the RCLK input with the TCLK
signal, and the RPOS/RNEG inputs with the TPOS/TNEG outputs. When LLB is enabled, the following
will occur:
1. The TPOS and TNEG pins will transmit an unframed all 1's.
2. Data at RPOS and RNEG will be ignored.
3. All receive side signals will take on timing synchronous with TCLK instead of RCLK.
CCR1: COMMON CONTROL REGISTER 2 (38h)
(MSB)
(LSB)
TFM
TB8ZS
TSLC96
TFDL
RFM
RB8ZS
RSLC96
RFDL
SYMBOL
POSITION
NAME AND DESCRIPTION
TFM
CCR2.7
Transmit Frame Mode Select.
0=D4 framing mode.
1=ESF framing mode.
TB8ZS
CCR2.6
Transmit B8ZS Enable.
0=B8ZS disabled.
1=B8ZS enabled.
TSLC96
CCR2.5
Transmit SLC-96/Fs Bit Insertion Enable.
0=SLC-96 disabled.
1=SLC-96 enabled.
TFDL
CCR2.4
Transmit Zero Stuffer Enable.
0=zero stuffer disabled.
1=zero stuffer enabled.
RFM
CCR2.3
Receive Frame Mode Select.
0=D4 framing mode.
1=ESF framing mode.
RB8ZS
CCR2.2
Receive B8ZS Enable.
0=B8ZS disabled.
1=B8ZS enabled.
RSLC96
CCR2.1
Receive SLC-96 Enable.
0=SLC-96 disabled.
1=SLC-96 enabled.
RFDL
CCR2.0
Receive Zero Destuffer Enable.
0=zero destuffer disabled.
1=zero destuffer enabled.
相關(guān)PDF資料 |
PDF描述 |
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