Table 02h, Register B9h: FETG ENABLE0 FACTORY DEFAULT 00h READ ACCESS PW2 WRITE ACCESS PW2 MEMOR" />
參數(shù)資料
型號： DS1875T+T&R
廠商： Maxim Integrated Products
文件頁數(shù)： 73/92頁
文件大小： 0K
描述： IC SFP CTRLR/TRIPLEXER 38-TQFN
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準包裝： 2,500
應(yīng)用： 光纖
接口： I²C
電源電壓： 2.85 V ~ 3.9 V
封裝/外殼： 38-WFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 38-TQFN（5x7）
包裝： 帶卷 (TR)
安裝類型： 表面貼裝
DS1875
Table 02h, Register B9h: FETG ENABLE0
FACTORY DEFAULT
00h
READ ACCESS
PW2
WRITE ACCESS
PW2
MEMORY TYPE
Nonvolatile (SEE)
B9h
TXP HI EN
TXP LO EN
BIAS HI EN
BIAS MAX
EN
RESERVED
BIT 7
BIT 0
Configures the maskable interrupt for the FETG pin.
BIT 7
TXP HI EN: Enables/disables active interrupts on the FETG pin due to TXP fast comparisons above the
threshold limit.
0 = Disable (Default)
1 = Enable
BIT 6
TXP LO EN: Enables/disables active interrupts on the FETG pin due to TXP fast comparisons below the
threshold limit.
0 = Disable (Default)
1 = Enable
BIT 5
BIAS HI EN: Enables/disables active interrupts on the FETG pin due to BIAS fast comparisons above
the threshold limit.
0 = Disable. (Default)
1 = Enable
BIT 4
BIAS MAX EN: Enables/disables active interrupts on the FETG pin due to BIAS fast comparison s
below the threshold limit.
0 = Disable (Default)
1 = Enable
BITS 3:0
RESERVED (Default = 0)
PON Triplexer and SFP Controller
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75
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PDF描述
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