參數(shù)資料
型號： DS1689S
英文描述： 3-Volt/5-Volt Serialized Real-Time Clock with NV RAM Control
中文描述： 3-Volt/5-Volt序列實(shí)時時鐘的非易失RAM控制
文件頁數(shù)： 24/32頁
文件大?。?/td> 321K
代理商： DS1689S
DS1689/DS1693
24 of 32
DC ELECTRICAL CHARACTERISTICS
Over the operating range (3V)
TYP
MAX
UNITS
5
10
0.5
2
+1
+1
-160
-1
PARAMETER
Average V
CC
Power Supply Current
CMOS Standby Current (
CS
=V
CC
-0.2V)
Input Leakage Current (any input)
CEI
Input Leakage
PSEL Input Leakage
Output Leakage Current
Output Logic 1 Voltage (I
OUT
= 0.4 mA)
Output Logic 0 Voltage (I
OUT
= 0.8 mA)
Output Voltage
SYMBOL
I
CC1
I
CC2
I
IL
I
CEI
I
PSEL
I
OL
V
OH
V
OL
V
CCO1
MIN
NOTES
2, 3
2, 3
mA
mA
A
A
A
A
V
V
V
-1
-160
+1
+160
2.4
15
16
8
0.4
V
CC
-0.3
4
Output Current
Power-Fail Trip Point
Output Voltage
I
CCO1
V
PF
V
CCO2
50
2.7
mA
V
V
4
5
6
2.5
V
BAT
-0.3
2.6
Output Current
Battery Leakage OSC ON
Battery Leakage OSC OFF
I/O Leakage
I
CCO2
I
BAT1
I
BAT2
I
LO
I
OLPWR
Z
CE
100
1000
150
+1
4
120
A
6
500
50
nA
nA
A
mA
17
7
1
12
-1
PWR
Output @ 0.4V
CEI
to
CEO
Impedance
RTC AC TIMING CHARACTERISTICS
Over the operating range (3V)
TYP
MAX
UNITS
DC
PARAMETER
Cycle Time
Pulse Width,
RD
/
WR
Low
Pulse Width,
RD
/
WR
High
Input Rise and Fall Time
Chip Select Setup Time Before
WR
, or
RD
Chip Select Hold Time
Read Data Hold Time
Write Data Hold Time
Muxed Address Valid Time to ALE Fall
Muxed Address Hold Time from ALE Fall
RD
or
WR
High Setup to ALE Rise
Pulse Width ALE High
ALE Low Setup to
RD
or
WR
Fall
Output Data Delay Time from
RD
Data Setup Time
IRQ
Release from
RD
SYMBOL
t
CYC
PW
RWL
PW
RWH
t
R
, t
F
t
CS
t
CH
t
DHR
t
DHW
t
ASL
t
AHL
t
ASD
PW
ASH
t
ASED
t
DDR
t
DSW
t
IRD
t
CED
MIN
915
375
450
NOTES
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
30
75
0
10
0
90
30
30
180
120
20
180
120
370
9
2
s
CEI
to
CEO
Delay
20
ns
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PDF描述
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