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  • 參數(shù)資料
    型號: DJIXPECD0SE001
    廠商: Intel Corp.
    英文描述: Advanced 8-Port 10/100 Mbps PHY Transceivers
    中文描述: 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器
    文件頁數(shù): 178/226頁
    文件大?。?/td> 1575K
    代理商: DJIXPECD0SE001
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    LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
    180
    Datasheet
    Document Number: 249241
    Revision Number: 007
    Revision Date: August 28, 2003
    Figure 41. Intel
    LXT9785/LXT9785E SMII - 100BASE-FX Receive Timing
    Table 62. Intel
    LXT9785/LXT9785E SMII - 100BASE-FX Receive Timing Parameters
    Parameter
    Sym
    Min
    Typ
    1
    Max
    Units
    Test Conditions
    RxData output delay from REFCLK
    rising edge
    t1
    1.5
    5
    ns
    Minimum C
    L
    = 5 pF
    Maximum C
    L
    = 20 pF
    RxData Rise/Fall Time
    t2
    1
    ns
    Receive start of /J/ to CRS asserted
    t3
    18
    26
    BT
    2
    Synchronous
    sampling of SMII
    Receive start of /T/ to CRS de-
    asserted
    t4
    23
    27
    BT
    2
    Synchronous
    sampling of SMII
    SYNC setup to REFCLK rising edge
    t5
    1.5
    ns
    SYNC hold from REFCLK rising edge
    t6
    1.0
    ns
    1. Typical values are at 25 °C and are for design aid only; not guaranteed and not subject to production
    testing.
    2. “BT” signifies bit times at the line rate (that is, BT = 100 ns if using 10BASE-T, BT = 10 ns if using
    100BASE-TX or 100BASE-FX).
    NOTE:
    The table latency values are derived with the hardware configuration pins FIFOSEL[1:0] set at a
    default configuration of 00 (32 bits of initial fill).
    REFCLK
    RxData
    TPFI
    t
    3
    t
    1
    t
    2
    t
    4
    t
    6
    t
    5
    SYNC
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