參數(shù)資料
型號(hào)： DG423DY+T
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 9/12頁(yè)
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描述： IC SWITCH DUAL SPDT 16SOIC
標(biāo)準(zhǔn)包裝： 2,500
功能： 開(kāi)關(guān)
電路： 2 x SPDT
導(dǎo)通狀態(tài)電阻： 35 歐姆
電壓電源： 單/雙電源
電壓 - 電源，單路/雙路(±)： 10 V ~ 30 V，±4.5 V ~ 20 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-SOIC（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 16-SOIC
包裝： 帶卷 (TR)
DG421/DG423/DG425
Improved Low-Power,
CMOS Analog Switches with Latches
6
_______________________________________________________________________________________
D
-15V
(
)
V-
RL
VOUT
V+
+15V
+5V
VL
GND
VD = 10V for tON
VD = -10V for tOFF
IN
LOGIC
INPUT
REPEAT TEST FOR IN2 AND S2.
CL INCLUDES FIXTURE AND STRAY CAPACITANCE.
CL
SWITCH OUTPUT
S
LOGIC
INPUT
SWITCH
OUTPUT
tR < 20ns
tF < 20ns
VOUT
tOFF
50%
3V
0V
NOTE: LOGIC INPUT WAVEFORM IS INVERTED FOR
SWITCHES THAT HAVE THE OPPOSITE LOGIC SENSE.
DG421
DG423
DG425
VOUT = VD
RL
RL + rDS(ON)
0.9 x VOUT
-VOUT
tON
*VD = 10V for tON, VD = -10V for tOFF
Figure 2. Switching Time
3V
0
3V
0
3V
0
VOUT
0
WR
IN
RS
SWITCH
OUTPUT
1.5V
tWW
tDW
tWD
2.0V
0.8V
1.5V
tRS
tOFF(RS)
0.8 x VOUT
Figure 3. Latch Timing
VOUT is the steady-state output with the switch on. Feedthrough via switch capacitance may result in spikes at the
leading and trailing edge of the output waveform.
______________________________________________Timing Diagrams/Test Circuits
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