基于一個(gè)多路計(jì)時(shí)系統(tǒng)的設(shè)計(jì)方案
基于FPGA的時(shí)間間隔測(cè)量模塊設(shè)計(jì)
基于CPLD和ISA總線的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
對(duì)C語(yǔ)言編程者的Verilog開(kāi)發(fā)指南實(shí)例
基于比時(shí)法的晶振頻率測(cè)量建模與分析
采用FPGA的可編程電壓源系統(tǒng)原理及設(shè)計(jì)
基于CPLD的異步串行通訊控制器的研究與設(shè)計(jì)
MAXQ3180入門(mén)：寄存器配置
基于虛擬儀器技術(shù)的無(wú)線電高度表動(dòng)態(tài)測(cè)試系統(tǒng)
基于FPGA技術(shù)的智能導(dǎo)盲犬設(shè)計(jì)
基于嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案
LED顯示屏數(shù)據(jù)處理技術(shù)
LED顯示屏自動(dòng)亮度控制技術(shù)
基于霍耳效應(yīng)的電機(jī)控制芯片設(shè)計(jì)
關(guān)于FPGA在直流電機(jī)位置控制中的應(yīng)用
基于高精度的交流伺服定剪系統(tǒng)設(shè)計(jì)方案
基于CPLD器件在時(shí)間統(tǒng)一系統(tǒng)中的應(yīng)用
基于FPGA的永磁同步電機(jī)控制器設(shè)計(jì)
基于CPLD的多次重觸發(fā)存儲(chǔ)測(cè)試系統(tǒng)設(shè)計(jì)
基于FPGA的超聲波氣體流量計(jì)中AGC的實(shí)現(xiàn)
利用FPGA實(shí)現(xiàn)HDB3編解碼功能
基于USB2.0的高速圖像傳輸系統(tǒng)設(shè)計(jì)
IR-UWB通信系統(tǒng)高速USB接口的設(shè)計(jì)與實(shí)現(xiàn)
HART協(xié)議在智能電磁流量計(jì)中的設(shè)計(jì)應(yīng)用
無(wú)線數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方案
源碼級(jí)和算法級(jí)的功耗測(cè)試與優(yōu)化
基于一種寬帶數(shù)字接收機(jī)的信道化設(shè)計(jì)
應(yīng)對(duì)嵌入式系統(tǒng)設(shè)計(jì)中的接口不兼容性
基于SCM和PLC的兩種步進(jìn)電機(jī)控制方法
基于PDM技術(shù)的AGC電路設(shè)計(jì)
基于FPGA的SPWM變頻系統(tǒng)設(shè)計(jì)
具有PCI和并行接口的數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
基于FPGA在彈上信息處理機(jī)中的應(yīng)用
基于AHB接口的高性能LCD控制器IP設(shè)計(jì)
基于FPGA的B超數(shù)字圖像實(shí)時(shí)采集系統(tǒng)
基于Nios II DTMB單頻網(wǎng)適配器設(shè)計(jì)
基于CPLD的頻譜電平顯示電路設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA+PC104的數(shù)據(jù)處理系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的光電抗干擾電路設(shè)計(jì)方案
基于FPGA的高速定點(diǎn)FFT算法的設(shè)計(jì)方案
基于FPGA嵌入式系統(tǒng)的雷達(dá)信號(hào)模擬器設(shè)計(jì)
解決SMPS應(yīng)用中電流模式控制的設(shè)計(jì)問(wèn)題
一種高性價(jià)比等精度數(shù)字頻率計(jì)方案設(shè)計(jì)
基于CAN核的四冗余通信板設(shè)計(jì)與仿真
嵌入式系統(tǒng)智能鍵盤(pán)的軟件設(shè)計(jì)
采用FPGA實(shí)現(xiàn)發(fā)電機(jī)組頻率測(cè)量計(jì)的設(shè)計(jì)
低頻數(shù)字相位（頻率）測(cè)量的CPLD實(shí)現(xiàn)
一維精密平臺(tái)模擬簡(jiǎn)諧振動(dòng)的設(shè)計(jì)
超高速轉(zhuǎn)換器ADC08xxxx系列的校準(zhǔn)
雷達(dá)視頻積累算法在FPGA上的實(shí)現(xiàn)
買賣網(wǎng)計(jì)數(shù)器、計(jì)數(shù)器技術(shù)資料、計(jì)數(shù)器開(kāi)發(fā)技術(shù)
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