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參數(shù)資料
型號： DAC8512FP
廠商： Analog Devices Inc
文件頁數(shù)： 15/20頁
文件大小： 0K
描述： IC DAC 12BIT 5V COMPLETE 8-DIP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
產(chǎn)品變化通告： Product Discontinuance 27/Oct/2011
標(biāo)準(zhǔn)包裝： 50
設(shè)置時間： 16µs
位數(shù)： 12
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 1
電壓電源： 單電源
功率耗散（最大）： 2.5mW
工作溫度： -40°C ~ 85°C
安裝類型： 通孔
封裝/外殼： 8-DIP（0.300"，7.62mm）
供應(yīng)商設(shè)備封裝： 8-PDIP
包裝： 管件
輸出數(shù)目和類型： 1 電壓，單極；1 電壓，雙極
采樣率（每秒）： 62.5k
DAC8512
–4–
REV. A
CLR
t
csh
D11
D10
D9
D8
D7
D6
D5
D3
D4
D1
D2
D0
t
ld2
t
css
t
ld1
tS
t
dh
t
ds
t
cl
t
ch
t
ldw
t
s
t
clrw
±1 LSB
ERROR BAND
SDI
CLK
CS
SDI
CLK
FS
ZS
VOUT
LD
Figure 1. Timing Diagram
DATA
SHIFT
REGISTER
ESD PROTECTION DIODES TO VDD AND GND
SDI
CS
CLK
Figure 2. Equivalent Clock Input Logic
Table I. Control-Logic Truth Table
CS
2
CLK
2
CLR
LD
Serial Shift Register Function
DAC Register Function
H
X
H
No Effect
Latched
L
H
No Effect
Latched
L
H
No Effect
Latched
L
↑+
H
Shift-Register-Data Advanced One Bit
Latched
↑+
L
H
Shift-Register-Data Advanced One Bit
Latched
HX
H
↓–
No Effect
Updated with Current Shift Register Contents
H
X
H
L
No Effect
Transparent
H
X
L
X
No Effect
Loaded with All Zeros
HX
↑+
H
No Effect
Latched All Zeros
NOTES
l
↑+ positive logic transition; ↓– negative logic transition; X = Don’t Care.
2CS and CLK are interchangeable.
3Returning CS HIGH avoids an additional “false clock” of serial data input.
4Do not clock in serial data while LD is LOW.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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