8 FN6785.0 July 29, 2010 SPI Master Mode Interface Port Timing T
參數(shù)資料
型號： D2-45057-QR
廠商： Intersil
文件頁數(shù)： 30/31頁
文件大?。?/td> 0K
描述： IC DGTL AMP PWM CTRLR 68QFN
標(biāo)準(zhǔn)包裝： 30
系列： D2Audio™
類型： D 類
輸出類型： 2 通道（立體聲）
在某負(fù)載時最大輸出功率 x 通道數(shù)量： 30W x 1 @ 8 歐姆
電源電壓： 9 V ~ 26 V
安裝類型： 表面貼裝
供應(yīng)商設(shè)備封裝： 68-QFN 裸露焊盤（10x10）
封裝/外殼： 68-VFQFN 裸露焊盤
包裝： 管件
D2-45057, D2-45157
8
FN6785.0
July 29, 2010
SPI Master Mode Interface Port Timing TA = +25°C, CVDD = PLLVDD = 1.8V ±5%, RVDD = PWMVDD = 3.3V
±10%. All grounds at 0.0V. All voltages referenced to ground.
SYMBOL
DESCRIPTION
MIN
MAX
UNIT
tV
MOSI Valid From Clock Edge
-
8
ns
tS
MISO Setup to Clock Edge
10
-
ns
tH
MISO Hold From Clock Edge
1 system clock + 2ns
tWI
nSS Minimum Width
3 system clocks + 2ns
SPI Slave Mode Interface Port Timing TA = +25°C, CVDD = PLLVDD = 1.8V ±5%, RVDD = PWMVDD = 3.3V
±10%. All grounds at 0.0V. All voltages referenced to ground.
SYMBOL
DESCRIPTION
MIN
MAX
UNIT
tV
MISO Valid From Clock Edge
3 system clocks + 2ns
tS
MOSI Setup to Clock Edge
10
-
ns
tH
MOSI Hold From Clock Edge
1 system clock + 2ns
tWI
nSS Minimum Width
3 system clocks + 2ns
SCK(CPHA = 1, CPOL = 0)
MOSI
nSS
SCK(CPHA = 0, CPOL = 0)
MISO(CPHA = 0)
tV
tH
tS
tWI
FIGURE 3. SPI TIMING
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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