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參數資料
| 型號： | CY39200V484-125BGI |
| 廠商： | Cypress Semiconductor Corp. |
| 英文描述： | ADAPTERS, COAX; F MALE TO F FEMALE; MAX VSWR: 1.30:1 # 3 GHz; *PRECISION ADAPTER* |
| 中文描述： | CPLD器件在FPGA的密度 |
| 文件頁數： | 25/86頁 |
| 文件大?。?/td> | 1212K |
| 代理商： | CY39200V484-125BGI |
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Delta39K ISR
CPLD Family
Document #: 38-03039 Rev. *H
Page 25 of 86
Switching Waveforms
(continued)
Registered Output with Synchronous Clocking (Macrocell)
t
MCS
INPUT
SYNCHRONOUS
t
MCCO
REGISTERED
OUTPUT
t
MCH
CLOCK
Registered Input in I/O Cell
t
IOS
DATA
INPUT
INPUT REGISTER
CLOCK
t
IOCO
REGISTERED
OUTPUT
t
IOH
Clock to Clock
INPUT REGISTER
CLOCK
MACROCELL
REGISTER CLOCK
t
SCS
t
ICS
PT Clock to PT Clock
DATA
INPUT
PT CLOCK
t
SCS2PT
t
MCSPT
相關PDF資料 |
PDF描述 |
|---|---|
| CY39100V484-125MBC | CPLDs at FPGA Densities |
| CY39165V484-125MBC | CPLDs at FPGA Densities |
| CY39200V484-125MBC | ADAPTERS, COAX; 1.85mm FEMALE TO SSMA MALE; MAX VSWR: 1.30:1 @ 40 GHz; *PRECISION ADAPTER* |
| CY39100V484-125MBI | CPLDs at FPGA Densities |
| CY39165V484-125MBI | CPLDs at FPGA Densities |
相關代理商/技術參數 |
參數描述 |
|---|---|
| CY39200V484-125MBC | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V484-125MBI | 制造商:CYPRESS 制造商全稱:Cypress Semiconductor 功能描述:CPLDs at FPGA Densities |
| CY39200V484-181BBC | 制造商:Cypress Semiconductor 功能描述: |
| CY39200V484-181BBXC | 功能描述:CPLD - 復雜可編程邏輯器件 Delta39K 200K 181MHz COM RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| CY39200V484-83BBXC | 功能描述:CPLD - 復雜可編程邏輯器件 Delta39K 200K 83MHz COM RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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