Left Right Clock (Input/Output) - Determine" />
參數(shù)資料
型號(hào)： CS53L21-CNZ
廠商： Cirrus Logic Inc
文件頁(yè)數(shù)： 23/26頁(yè)
文件大?。?/td> 0K
描述： IC ADC STEREO 24BIT 98DB 32QFN
標(biāo)準(zhǔn)包裝： 60
位數(shù)： 24
采樣率（每秒）： 100k
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 30mW
電壓電源： 模擬和數(shù)字
工作溫度： -10°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 32-QFN
供應(yīng)商設(shè)備封裝： 32-QFN（5x5）
包裝： 托盤
輸入數(shù)目和類型： 3 個(gè)單端，單極
產(chǎn)品目錄頁(yè)面： 755 (CN2011-ZH PDF)
配用： 598-1550-ND - BOARD EVAL FOR CS53L21 ADC
其它名稱： 598-1191
6
DS700PP1
CS53L21
1. PIN DESCRIPTIONS - SOFTWARE (HARDWARE) MODE
Pin Name
#
Pin Description
LRCK
1
Left Right Clock (Input/Output) - Determines which channel, Left or Right, is currently active on the
serial audio data line.
SDA/CDIN
(MCLKDIV2)
2
Serial Control Data (Input/Output) - SDA is a data I/O in IC Mode. CDIN is the input data line for the
control port interface in SPI Mode.
MCLK Divide by 2 (Input) - Hardware Mode: Divides the MCLK by 2 prior to all internal circuitry.
SCL/CCLK
(IS/LJ)
3
Serial Control Port Clock (Input) - Serial clock for the serial control port.
Interface Format Selection (Input) - Hardware Mode: Selects between IS & Left-Justified interface for-
mats for the ADC.
AD0/CS
(TSTN)
4
Address Bit 0 (IC) / Control Port Chip Select (SPI) (Input) - AD0 is a chip address pin in IC Mode; CS
is the chip-select signal for SPI format.
Test In (Input) - Hardware Mode: This pin is an input used for test purposes only and should be tied to
DGND for normal operation.
VA_PULLUP
5
Reference Pull-up (Input) - This pin is an input used for test purposes only and must be pulled-up to VA
using a 47 k
Ω resistor.
TSTO
6
Test Out (Output) - This pin is an output used for test purposes only and must be left “floating” (no con-
nection external to the pin).
AGND
7
Analog Ground (Input) - Ground reference for the internal analog section.
TSTO
8
Test Out (Output) - This pin is an output used for test purposes only and must be left “floating” (no con-
nection external to the pin).
10
9
8
7
6
5
4
3
2
1
11
12
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23
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25
26
27
28
29
30
31
32
CS53L21
VD
DGND
SDOUT
(M/S
)
MCLK
TSTN
SCLK
TSTO
NIC
VA
AGND
TST
O
FILT
+
VQ
SDA/CDIN (MCLKDIV2)
SCL/CCLK (IS/LJ)
AD0/CS (TSTN)
TSTO
VL
RESET
AGND
TSTO
AFILTA
AIN1A
AIN1B
AIN2A
AIN2B/BIAS
MICIN1/AIN3A
MICIN2/BIAS/AIN3B
AFILTB
VA_PULLUP
LRCK
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PDF描述
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