參數(shù)資料
型號： CP80C86-2Z
廠商： Intersil
文件頁數(shù)： 19/37頁
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描述： IC CPU 16BIT 5V 8MHZ 40-PDIP
標(biāo)準(zhǔn)包裝： 9
處理器類型： 80C86 16-位
速度： 8MHz
電壓： 4.5 ~ 5.5V
安裝類型： 通孔
封裝/外殼： 40-DIP（0.600"，15.24mm）
供應(yīng)商設(shè)備封裝： 40-DIP
包裝： 管件
26
FN2957.3
January 9, 2009
FIGURE 8B. BUS TIMING - MAXIMUM MODE (USING 82C88)
NOTES:
19. Signals at 82C84A or 82C86 are shown for reference only.
20. The issuance of the 82C88 command and control signals (MRDC, MWTC, AMWC, IORC, IOWC, AIOWC, INTA and DEN) lags the active high
82C88 CEN.
21. Status inactive in state just prior to t4.
22. Cascade address is valid between first and second INTA cycles.
23. Two INTA cycles run back-to-back. The 80C86 local ADDR/DATA bus is floating during both INTA cycles. Control for pointer address is shown
for second INTA cycle.
Waveforms (Continued)
t1
t2
t3
t4
t
W
TCLSH
(SEE NOTE 20))
TCLDX2
TCLDV
TCLAX
TCLMH
(18) TCLML
TCHDTH
(19) TCLMH
TCVNX
TCLAV
TCHSV
TCLSH
CLK
S2, S1, S0 (EXCEPT HALT)
WRITE CYCLE
AD15-AD0
DEN
AMWC OR AIOWC
MWTC OR IOWC
82C88
OUTPUTS
SEE NOTES
18, 19
INTA CYCLE
AD
15-AD0
(SEE NOTES 21, 22)
AD
15-AD0
MCE/
PDEN
DT/
R
INTA
DEN
82C88 OUTPUTS
SEE NOTES 18, 19
RESERVED FOR
CASCADE ADDR
(25) TCLAZ
(30) TCLMCH
TCVNV
SOFTWARE
HALT -
RD, MRDC, IORC, MWTC, AMWC, IOWC, AIOWC, INTA, S0, S1 = VOH
(18) TCLML
TCLMH (19)
TCLDX1 (7)
(18)TCLML
POINTER
INVALID ADDRESS
AD
15-AD0
S2
TCHDTL
TCHSV (21)
(34)
(22)
(33)
(24)
DATA
TCVNX (36)
(19)
(6)
TDVCL
TCLMCL
(32)
(41)
(42)
(35)
(36)
(23)
(21)
(22)
TCLAV
(23)
TCVNV
(35)
(28) TSVMCH
80C86
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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CP80C88-2 功能描述:微處理器 - MPU CPU 8/16BIT 5V 8MHZ 40PDIP COM RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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CP80C88R2489 制造商:Rochester Electronics LLC 功能描述:- Bulk
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