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參數(shù)資料
| 型號： | CL7192EQC160-12P |
| 英文描述： | Laser-Programmable Complex PLD |
| 中文描述： | 激光可編程復(fù)雜可編程邏輯器件 |
| 文件頁數(shù)： | 9/16頁 |
| 文件大?。?/td> | 183K |
| 代理商： | CL7192EQC160-12P |
CL7192E and CL7192S Laser Processed Logic Devices
Page 9
Parameter
Conditions
Min
Max
Min
Max
Unit
t
PD1
Input to non-registered output
C
L
= 35 pF
12.0
12.0
ns
t
PD2
I/O input to non-registered output
C
L
= 35 pF
12.0
12.0
ns
t
SU
Global clock setup time
7.0
10.0
ns
t
H
Global clock hold time
0.0
0.0
ns
t
FSU
Global clock setup time of fast input
3.0
3.0
ns
t
FH
Global clock hold time of fast input
0.0
0.0
ns
t
CO1
Global clock to output delay
C
L
= 35 pF
6.0
6.0
ns
t
CH
Global clock high time
4.0
4.0
ns
t
CL
Global clock low time
4.0
4.0
ns
t
ASU
Array clock setup time
3.0
4.0
ns
t
AH
Array clock hold time
4.0
4.0
ns
t
ACO1
Array clock to output delay
C
L
= 35 pF
12.0
12.0
ns
t
ACH
Array clock high time
5.0
5.0
ns
t
ACL
Array clock low time
5.0
5.0
ns
t
ODH
Output data hold time after clock
C
L
= 35 pF
1.0
1.0
ns
t
CNT
Minimum global clock period
11.0
11.0
ns
f
CNT
Maximum internal global clock frequency
90.9
90.9
MHz
t
ACNT
Minimum array clock period
11.0
11.0
ns
f
ACNT
Maximum internal array clock frequency
90.9
90.9
MHz
Symbol
Speed: -12P
Speed: -12
7K tbl 06D2
External Timing Parameters
AC Electrical Specifications cont.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CL7192EQC160-15 | |
| CL7192EQC160-20 | Laser-Programmable Complex PLD |
| CL7192EQI160-20 | |
| CL7192SQC160-10 | |
| CL7192SQC160-15 | Laser-Programmable Complex PLD |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CL72001X | 制造商:BANDRIDGE 功能描述:LEAD AV CAT5 0.5M |
| CL72002X | 制造商:BANDRIDGE 功能描述:LEAD AV CAT5 2M |
| CL72003X | 制造商:BANDRIDGE 功能描述:LEAD AV CAT5 3M |
| CL72008X | 制造商:BANDRIDGE 功能描述:LEAD AV CAT5 7.5M |
| CL72015X | 制造商:BANDRIDGE 功能描述:LEAD AV CAT5 15M |
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