參數(shù)資料
型號(hào)： CDB4382A
廠(chǎng)商： Cirrus Logic Inc
文件頁(yè)數(shù)： 16/50頁(yè)
文件大?。?/td> 0K
描述： BOARD EVAL FOR CS4382A DAC
標(biāo)準(zhǔn)包裝： 1
DAC 的數(shù)量： 8
位數(shù)： 24
采樣率（每秒）： 192k
數(shù)據(jù)接口： 串行
DAC 型： 電壓
工作溫度： -40°C ~ 85°C
已供物品： 板
已用 IC / 零件： CS4382A
產(chǎn)品目錄頁(yè)面： 757 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS4382A-DQZR-ND - IC DAC 8CH 114DB 192KHZ 48-LQFP
CS4382A-DQZ-ND - IC DAC 8CH 114DB 192KHZ 48-LQFP
CS4382A-CQZR-ND - IC DAC 8CH 114DB 192KHZ 48-LQFP
598-1061-ND - IC DAC 8CH 114DB 192KHZ 48LQFP
其它名稱(chēng)： 598-1524
DS618F2
23
CS4382A
4.3
Digital Interface Formats
The serial port operates as a slave and supports the IS, Left-justified, and Right-justified digital interface
formats with varying bit depths from 16 to 24 as shown in Figures 7-12. Data is clocked into the DAC on the
rising edge.
LRCK
SCLK
Left Channel
Right Channel
SDINx
+3 +2 +1
+5 +4
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
-1 -2 -3 -4
MSB
LSB
MSB
LSB
Figure 7. Format 0 - Left-Justified up to 24-bit Data
LRCK
SCLK
Left Channel
Right Channel
SDINx
+3 +2 +1
+5 +4
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
-1 -2 -3 -4
MSB
LSB
Figure 8. Format 1 - IS up to 24-bit Data
LRCK
SCLK
Left Channel
Right Channel
SDINx
6
543
2
1
0
98
7
15 14 13 12 11 10
65
4
3
2
1
0
98
7
15 14 13 12 11 10
32 clocks
Figure 9. Format 2 - Right-Justified 16-bit Data
LRCK
SCLK
Left Channel
SDINx
6
543
2
1
0
7
23 22 21 20 19 18
65
4
3
2
1
0
7
23 22 21 20 19 18
32 clocks
0
Right Channel
Figure 10. Format 3 - Right-Justified 24-bit Data
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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