SWITCHING CHARACTERISTICS - CONTROL PORT - SPI FORMAT
參數(shù)資料
型號： CDB4351
廠商： Cirrus Logic Inc
文件頁數(shù)： 4/37頁
文件大?。?/td> 0K
描述： BOARD EVAL FOR CS4351 DAC
標(biāo)準(zhǔn)包裝： 1
系列： Popguard®
DAC 的數(shù)量： 2
位數(shù)： 24
采樣率（每秒）： 192k
數(shù)據(jù)接口： 串行
DAC 型： 電壓
工作溫度： -10°C ~ 70°C
已供物品： 板，纜線，CD
已用 IC / 零件： CS4351
產(chǎn)品目錄頁面： 757 (CN2011-ZH PDF)
相關(guān)產(chǎn)品： CS4351-DZZ-ND - IC DAC STER 112DB 192KHZ 20TSSOP
598-1055-5-ND - IC DAC STER 112DB 192KHZ 20TSSOP
其它名稱： 598-1152
12
DS566F1
CS4351
SWITCHING CHARACTERISTICS - CONTROL PORT - SPI FORMAT
(Inputs: Logic 0 = GND, Logic 1 = VL, CL =20pF)
Notes:
8.
tspi only needed before first falling edge of CS after RST rising edge. tspi = 0 at all other times.
9.
Data must be held for sufficient time to bridge the transition time of CCLK.
10. For FSCK < 1 MHz.
Parameter
Symbol
Min
Max
Unit
CCLK Clock Frequency
fsclk
-6
MHz
RST Rising Edge to CS Falling
tsrs
500
-
ns
CCLK Edge to CS Falling
tspi
500
-
ns
CS High Time Between Transmissions
tcsh
1.0
-
s
CS Falling to CCLK Edge
tcss
20
-
ns
CCLK Low Time
tscl
66
-
ns
CCLK High Time
tsch
66
-
ns
CDIN to CCLK Rising Setup Time
tdsu
40
-
ns
CCLK Rising to DATA Hold Time
tdh
17
-
ns
Rise Time of CCLK and CDIN
tr2
-
100
ns
Fall Time of CCLK and CDIN
tf2
-
100
ns
t r2
t f2
t dsu t dh
t sch
t scl
CS
CCLK
CDIN
t css
t csh
t spi
t srs
RST
Figure 3. Control Port Timing - SPI Format (Write)
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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