參數(shù)資料
型號： CD74HC273SM
廠商： Texas Instruments, Inc.
英文描述： High-Speed CMOS Logic Octal D-Type Flip-Flop with Reset
中文描述： 高速CMOS邏輯與復(fù)位八路D類觸發(fā)器
文件頁數(shù)： 5/13頁
文件大小： 295K
代理商： CD74HC273SM
5
Clock Pulse Width (Figure 1)
t
W
-
2
80
-
-
100
-
120
-
ns
4.5
16
-
-
20
-
24
-
ns
6
14
-
-
17
-
20
-
ns
Set-up Time Data to Clock
(Figure 5)
t
SU
-
2
60
-
-
75
-
70
-
ns
4.5
12
-
-
15
-
18
-
ns
6
10
-
-
13
-
15
-
ns
Hold Time, Data to Clock
(Figure 5)
t
H
-
2
3
-
-
3
-
3
-
ns
4.5
3
-
-
3
-
3
-
ns
6
3
-
-
3
-
3
-
ns
Removal Time, MR to Clock
t
REM
-
2
50
-
-
65
-
75
-
ns
4.5
10
-
-
13
-
15
-
ns
6
9
-
-
11
-
13
-
ns
HCT TYPES
Maximum Clock Frequency
(Figure 2)
f
MAX
-
4.5
25
-
-
20
-
16
-
MHz
MR Pulse Width
(Figure 2)
t
w
-
4.5
12
-
-
15
-
18
-
ns
Clock Pulse Width (Figure 2)
t
w
-
4.5
20
-
-
25
-
30
-
ns
Set-up Time Data to Clock
(Figure 6)
t
SU
-
4.5
12
-
-
15
-
18
-
ns
Hold Time, Data to Clock
(Figure 6)
t
H
-
4.5
3
-
-
3
-
3
-
ns
Removal Time, MR to Clock
t
REM
-
4.5
10
-
-
13
-
15
-
ns
Switching Specifications
Input t
r
, t
f
= 6ns
PARAMETER
SYMBOL
TEST
CONDITIONS
V
CC
(V)
25
o
C
-40
o
C TO 85
o
C
-55
o
C TO
125
o
C
UNITS
TYP
MAX
MAX
MAX
HC TYPES
Propagation Delay,
Clock to Output
(Figure 3)
t
PLH
, t
PHL
C
L
= 50pF
2
-
150
190
225
ns
4.5
-
30
38
45
ns
6
-
26
30
38
ns
C
L
= 15pF
5
12
-
-
-
ns
Propagation Delay,
MR to Output
(Figure 3)
t
PHL
C
L
= 50pF
2
-
150
190
225
ns
4.5
-
30
38
45
ns
6
-
26
30
38
ns
Output Transition Time
(Figure 3)
t
TLH
, t
THL
C
L
= 50pF
2
-
75
95
110
ns
4.5
-
15
19
22
ns
6
-
13
16
19
ns
Input Capacitance
C
I
-
-
-
10
10
10
pF
Maximum Clock Frequency
f
MAX
C
L
= 15pF
5
60
-
-
-
MHz
Prerequisite For Switching Specifications
(Continued)
PARAMETER
SYMBOL
TEST
CONDITIONS
V
CC
(V)
25
o
C
-40
o
C TO 85
o
C
-55
o
C TO 125
o
C
UNITS
MIN
TYP
MAX
MIN
MAX
MIN
MAX
CD54/74HC273, CD54/74HCT273
相關(guān)PDF資料
PDF描述
CD74HC280M96E4 Low Current Operation at 250??A???Low Reverse Leakage,Low Noise Zener Diode(250??A?·￥?????μ?μ?????°????????????μ?μ?????????a?￡°???é???o3?o???????)
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參數(shù)描述
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