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參數(shù)資料
| 型號(hào)： | CD4046BMS |
| 廠商： | Intersil Corporation |
| 英文描述： | CMOS Micropower Phase Locked Loop(CMOS 微功耗鎖相環(huán)) |
| 中文描述： | 的CMOS微功耗鎖相環(huán)（的CMOS微功耗鎖相環(huán)） |
| 文件頁數(shù)： | 7/11頁 |
| 文件大?。?/td> | 109K |
| 代理商： | CD4046BMS |
7-892
CD4046BMS
Design Information
This information is a guide for approximating the values of external components for the CD4046BMS in a Phase-Locked-
Loop system. The selected external components must be within the following ranges:
5k
≤
R1, R2, RS
≤
1M
C1
≥
100pF at VDD
≥
5V
C1
≥
50pF at VDD
≥
10V
CHARACTERISTICS
PHASE
COMPARATOR USED
DESIGN INFORMATION
VCO Frequency
1
VCO Without Offset R2 =
∞
VCO With Offset
2
Same as for Number 1
For Number Signal Input
1
VCO will adjust to center frequency, fo
2
VCO will adjust to lowest operating frequency, fmin
Frequency Lock Range, 2fL
1, 2
2fL = full VCO frequency range
1, 2
2fL = fmax - fmin
Frequency Capture Range, 2fC
1
Loop Filter Component Selection
2
fC = fL
Phase Angle Between Signal and
Comparator
1
90
o
at center frequency (fo) approximating 0
o
and 180
o
at ends of lock
range (2fL)
2
Always 0
o
in lock
Locks On Harmonic of Center
Frequency
1
Yes
2
No
Signal Input Noise Rejection
1
High
2
Low
For further information, see
(1) F. Gardner, “Phase-Lock Techniques” John Wiley and Sons, New York 1966
(2) G. S. Moschytz, “Miniaturized RC Filters Using Phase-Locked Loop”, BSTJ, May, 1965
f
MAX
f
MIN
f
O
VDD/2
VDD
2f
L
VCO INPUT VOLTAGE
f
O
f
MAX
f
MIN
VDD/2
VDD
2f
L
VCO INPUT VOLTAGE
OUT
IN R3
τ
I = R3C2
C2
√
(1), (2)
2fC
≈
1
2
π
fL
τ
1
π
OUT
IN R3
C2
R4
For 2 fC, see Ref. (2)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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