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參數(shù)資料
| 型號： | CA502A105 |
| 英文描述： | Dual 2 to 4 line decoder 3 to 8 line decoder |
| 中文描述： | 邏輯IC |
| 文件頁數(shù)： | 1/1頁 |
| 文件大?。?/td> | 209K |
| 代理商： | CA502A105 |
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CA502A106 | Synchronous presettable 4-bit counter |
| CA502A107 | Synchronous presettable 4-bit counter |
| CA502A108 | Synchronous presettable 4-bit counter |
| CA502A109 | 8 bit SIPO shift register |
| CA502A110 | 8-bit PISO shift register |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| CA502A106 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
| CA502A107 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
| CA502A108 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
| CA502A109 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
| CA502A110 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
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