參數(shù)資料
型號： C8051F366-GQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 128/288頁
文件大?。?/td> 0K
描述： IC 8051 MCU 32K FLASH 32-LQFP
產(chǎn)品培訓模塊： Serial Communication Overview
標準包裝： 250
系列： C8051F36x
核心處理器： 8051
芯體尺寸： 8-位
速度： 50MHz
連通性： SMBus（2 線/I²C），SPI，UART/USART
外圍設(shè)備： POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 29
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 1K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 21x10b; D/A 1x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 32-LQFP
包裝： 托盤
配用： 336-1410-ND - KIT DEV FOR C8051F360 FAMILY
其它名稱： 336-1648
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Rev. 1.0
213
C8051F360/1/2/3/4/5/6/7/8/9
18.5. SMBus Transfer Modes
The SMBus interface may be configured to operate as master and/or slave. At any particular time, it will be
operating in one of the following four modes: Master Transmitter, Master Receiver, Slave Transmitter, or
Slave Receiver. The SMBus interface enters Master Mode any time a START is generated, and remains in
Master Mode until it loses an arbitration or generates a STOP. An SMBus interrupt is generated at the end
of all SMBus byte frames; however, note that the interrupt is generated before the ACK cycle when operat-
ing as a receiver, and after the ACK cycle when operating as a transmitter.
18.5.1. Master Transmitter Mode
Serial data is transmitted on SDA while the serial clock is output on SCL. The SMBus interface generates
the START condition and transmits the first byte containing the address of the target slave and the data
direction bit. In this case the data direction bit (R/W) will be logic ‘0’ (WRITE). The master then transmits
one or more bytes of serial data. After each byte is transmitted, an acknowledge bit is generated by the
slave. The transfer is ended when the STO bit is set and a STOP is generated. Note that the interface will
switch to Master Receiver Mode if SMB0DAT is not written following a Master Transmitter interrupt.
Figure 18.5 shows a typical Master Transmitter sequence. Two transmit data bytes are shown, though any
number of bytes may be transmitted. Notice that the ‘data byte transferred’ interrupts occur after the ACK
cycle in this mode.
A
S
W
P
Data Byte
SLA
S = START
P = STOP
A = ACK
W = WRITE
SLA = Slave Address
Received by SMBus
Interface
Transmitted by
SMBus Interface
Interrupt
Figure 18.5. Typical Master Transmitter Sequence
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PDF描述
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C8051F367-C-GMR 功能描述:8051 C8051F36x Microcontroller IC 8-Bit 50MHz 32KB (32K x 8) FLASH 28-QFN (5x5) 制造商:silicon labs 系列:C8051F36x 包裝:帶卷（TR） 零件狀態(tài):Not For New Designs 核心處理器:8051 核心尺寸:8-位 速度:50MHz 連接性:SMBus（2 線/I2C），SPI，UART/USART 外設(shè):POR，PWM，溫度傳感器，WDT I/O 數(shù):25 程序存儲容量:32KB（32K x 8） 程序存儲器類型:閃存 EEPROM 容量:- RAM 容量:1K x 8 電壓 - 電源（Vcc/Vdd）:2.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 17x10b；D/A 1x10b 振蕩器類型:內(nèi)部 工作溫度:-40°C ~ 85°C（TA） 封裝/外殼:28-VFQFN 裸露焊盤 供應(yīng)商器件封裝:28-QFN（5x5） 標準包裝:1,500
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