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參數(shù)資料
| 型號(hào)： | BU-62843B3-132S |
| 廠商： | DATA DEVICE CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, BGA128 |
| 封裝： | 0.815 X 0.815 INCH, 0.140 INCH HEIGHT, 1 MM PITCH, BGA-128 |
| 文件頁(yè)數(shù)： | 72/93頁(yè) |
| 文件大?。?/td> | 504K |
| 代理商： | BU-62843B3-132S |
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Data Device Corporation
62743_pre2.DOC
www.ddc-web.com
8-15-01
74
Table 58. CPU Reading Ram or Registers (Shown for 16-Bit, Buffered, Nonzero Wait Mode)
3.3V LOGIC
REF
DESCRIPTION
MIN TYP MAX
UNIT
t12 Output Data valid prior to READYD* falling (@20 MHz) (Note 6)
11
ns
@16 MHz (Note 6)
23
ns
@12 MHz (Note 6)
44
ns
@10 MHz (Note 6)
61
ns
t13 CLOCK IN rising edge delay to READYD* falling (Note 6)
40
ns
t14 READYD* falling to STRBD* rising release time.
∞
ns
t15
STRBD* rising edge delay to IOEN* rising edge and READYD*
rising edge (Note 6)
40
ns
t16 Output Data hold time following STRBD* rising edge.
0
ns
t17 STRBD* rising delay to output Data tri-state
40
ns
t18 STRBD* high hold time from READYD* rising
0
ns
t19 CLOCK IN rising edge delay to output data valid
40
ns
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PDF描述 |
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